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2.0 KiB
Python
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from .insn import *
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"""
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SD instruction
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"""
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class InsnSd(Insn):
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def elaborate(self, platform):
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m = super().elaborate(platform)
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m.d.comb += self.insn_imm.eq(Value.as_signed(Cat(self.rvfi_insn[7:12], self.rvfi_insn[25:32])))
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if self.params.csr_misa:
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m.d.comb += self.misa_ok.eq((self.rvfi_csr_misa_rdata & 0) == 0)
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m.d.comb += self.spec_csr_misa_rmask.eq(0)
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else:
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m.d.comb += self.misa_ok.eq(1)
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if self.params.aligned_mem:
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addr = Signal(self.params.xlen)
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m.d.comb += addr.eq(self.rvfi_rs1_rdata + self.insn_imm)
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m.d.comb += self.spec_valid.eq(self.rvfi_valid & (~self.insn_padding) & (self.insn_funct3 == 0b011) & (self.insn_opcode == 0b0100011))
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m.d.comb += self.spec_rs1_addr.eq(self.insn_rs1)
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m.d.comb += self.spec_rs2_addr.eq(self.insn_rs2)
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m.d.comb += self.spec_mem_addr.eq(addr & ~(self.params.xlen // 8 - 1))
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m.d.comb += self.spec_mem_wmask.eq(((1 << 8) - 1) << (addr - self.spec_mem_addr))
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m.d.comb += self.spec_mem_wdata.eq(self.rvfi_rs2_rdata << (8 * (addr - self.spec_mem_addr)))
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m.d.comb += self.spec_pc_wdata.eq(self.rvfi_pc_rdata + 4)
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m.d.comb += self.spec_trap.eq(((addr & (8 - 1)) != 0) | ~self.misa_ok)
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else:
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addr = Signal(self.params.xlen)
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m.d.comb += addr.eq(self.rvfi_rs1_rdata + self.insn_imm)
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m.d.comb += self.spec_valid.eq(self.rvfi_valid & (~self.insn_padding) & (self.insn_funct3 == 0b011) & (self.insn_opcode == 0b0100011))
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m.d.comb += self.spec_rs1_addr.eq(self.insn_rs1)
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m.d.comb += self.spec_rs2_addr.eq(self.insn_rs2)
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m.d.comb += self.spec_mem_addr.eq(addr)
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m.d.comb += self.spec_mem_wmask.eq((1 << 8) - 1)
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m.d.comb += self.spec_mem_wdata.eq(self.rvfi_rs2_rdata)
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m.d.comb += self.spec_pc_wdata.eq(self.rvfi_pc_rdata + 4)
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m.d.comb += self.spec_trap.eq(~self.misa_ok)
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return m
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