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eth: fix mio_pin setup
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parent
9ab40daca2
commit
d6b2321fee
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@ -39,6 +39,7 @@ impl Eth<(), ()> {
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slcr.mio_pin_16.write(
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slcr::MioPin16::zeroed()
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.l0_sel(true)
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.speed(true)
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.io_type(slcr::IoBufferType::Hstl)
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.pullup(true)
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.disable_rcvr(true)
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@ -47,6 +48,7 @@ impl Eth<(), ()> {
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slcr.mio_pin_21.write(
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slcr::MioPin21::zeroed()
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||||
.l0_sel(true)
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.speed(true)
|
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.io_type(slcr::IoBufferType::Hstl)
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||||
.pullup(true)
|
||||
.disable_rcvr(true)
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@ -55,6 +57,7 @@ impl Eth<(), ()> {
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slcr.mio_pin_20.write(
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||||
slcr::MioPin20::zeroed()
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||||
.l0_sel(true)
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||||
.speed(true)
|
||||
.io_type(slcr::IoBufferType::Hstl)
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||||
.pullup(true)
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.disable_rcvr(true)
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@ -62,6 +65,8 @@ impl Eth<(), ()> {
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// TXD2
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slcr.mio_pin_19.write(
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slcr::MioPin19::zeroed()
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.l0_sel(true)
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||||
.speed(true)
|
||||
.io_type(slcr::IoBufferType::Hstl)
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||||
.pullup(true)
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||||
.disable_rcvr(true)
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@ -69,6 +74,8 @@ impl Eth<(), ()> {
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// TXD1
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slcr.mio_pin_18.write(
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slcr::MioPin18::zeroed()
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||||
.l0_sel(true)
|
||||
.speed(true)
|
||||
.io_type(slcr::IoBufferType::Hstl)
|
||||
.pullup(true)
|
||||
.disable_rcvr(true)
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@ -77,6 +84,7 @@ impl Eth<(), ()> {
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slcr.mio_pin_17.write(
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||||
slcr::MioPin17::zeroed()
|
||||
.l0_sel(true)
|
||||
.speed(true)
|
||||
.io_type(slcr::IoBufferType::Hstl)
|
||||
.pullup(true)
|
||||
.disable_rcvr(true)
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