harry
/
zynq-rs
forked from M-Labs/zynq-rs
1
0
Fork 0
Code Issues Pull Requests Releases Wiki Activity
zynq-rs/libboard_zynq/src/ps7_init/zc706.rs

4114 lines
174 KiB
Rust
Raw Blame History

use super::InitOp::{self, *};
pub const INIT_DATA: &'static [InitOp] = &[
// *** ps7_debug_3_0 ***
// START: top
// .. START: CROSS TRIGGER CONFIGURATIONS
// .. .. START: UNLOCKING CTI REGISTERS
// .. .. KEY = 0xC5ACCE55
// .. .. ==> 0xF8898FB0[31:0] = 0xC5ACCE55U
// .. .. ==> MASK : 0xFFFFFFFFU VAL : 0xC5ACCE55U
// .. ..
MaskWrite(0xF8898FB0, 0xFFFFFFFF, 0xC5ACCE55),
// .. .. KEY = 0xC5ACCE55
// .. .. ==> 0xF8899FB0[31:0] = 0xC5ACCE55U
// .. .. ==> MASK : 0xFFFFFFFFU VAL : 0xC5ACCE55U
// .. ..
MaskWrite(0xF8899FB0, 0xFFFFFFFF, 0xC5ACCE55),
// .. .. KEY = 0xC5ACCE55
// .. .. ==> 0xF8809FB0[31:0] = 0xC5ACCE55U
// .. .. ==> MASK : 0xFFFFFFFFU VAL : 0xC5ACCE55U
// .. ..
MaskWrite(0xF8809FB0, 0xFFFFFFFF, 0xC5ACCE55),
// .. .. FINISH: UNLOCKING CTI REGISTERS
// .. .. START: ENABLING CTI MODULES AND CHANNELS
// .. .. FINISH: ENABLING CTI MODULES AND CHANNELS
// .. .. START: MAPPING CPU0, CPU1 AND FTM EVENTS TO CTM CHANNELS
// .. .. FINISH: MAPPING CPU0, CPU1 AND FTM EVENTS TO CTM CHANNELS
// .. FINISH: CROSS TRIGGER CONFIGURATIONS
// FINISH: top
// *** ps7_mio_init_data_3_0 ***
// START: top
// .. START: SLCR SETTINGS
// .. UNLOCK_KEY = 0xDF0D
// .. ==> 0xF8000008[15:0] = 0x0000DF0DU
// .. ==> MASK : 0x0000FFFFU VAL : 0x0000DF0DU
// ..
MaskWrite(0xF8000008, 0x0000FFFF, 0x0000DF0D),
// .. FINISH: SLCR SETTINGS
// .. START: OCM REMAPPING
// .. VREF_EN = 0x1
// .. ==> 0xF8000B00[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. VREF_SEL = 0x0
// .. ==> 0xF8000B00[6:4] = 0x00000000U
// .. ==> MASK : 0x00000070U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B00, 0x00000071, 0x00000001),
// .. FINISH: OCM REMAPPING
// .. START: DDRIOB SETTINGS
// .. reserved_INP_POWER = 0x0
// .. ==> 0xF8000B40[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. INP_TYPE = 0x0
// .. ==> 0xF8000B40[2:1] = 0x00000000U
// .. ==> MASK : 0x00000006U VAL : 0x00000000U
// .. DCI_UPDATE_B = 0x0
// .. ==> 0xF8000B40[3:3] = 0x00000000U
// .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. TERM_EN = 0x0
// .. ==> 0xF8000B40[4:4] = 0x00000000U
// .. ==> MASK : 0x00000010U VAL : 0x00000000U
// .. DCI_TYPE = 0x0
// .. ==> 0xF8000B40[6:5] = 0x00000000U
// .. ==> MASK : 0x00000060U VAL : 0x00000000U
// .. IBUF_DISABLE_MODE = 0x0
// .. ==> 0xF8000B40[7:7] = 0x00000000U
// .. ==> MASK : 0x00000080U VAL : 0x00000000U
// .. TERM_DISABLE_MODE = 0x0
// .. ==> 0xF8000B40[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. OUTPUT_EN = 0x3
// .. ==> 0xF8000B40[10:9] = 0x00000003U
// .. ==> MASK : 0x00000600U VAL : 0x00000600U
// .. PULLUP_EN = 0x0
// .. ==> 0xF8000B40[11:11] = 0x00000000U
// .. ==> MASK : 0x00000800U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B40, 0x00000FFF, 0x00000600),
// .. reserved_INP_POWER = 0x0
// .. ==> 0xF8000B44[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. INP_TYPE = 0x0
// .. ==> 0xF8000B44[2:1] = 0x00000000U
// .. ==> MASK : 0x00000006U VAL : 0x00000000U
// .. DCI_UPDATE_B = 0x0
// .. ==> 0xF8000B44[3:3] = 0x00000000U
// .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. TERM_EN = 0x0
// .. ==> 0xF8000B44[4:4] = 0x00000000U
// .. ==> MASK : 0x00000010U VAL : 0x00000000U
// .. DCI_TYPE = 0x0
// .. ==> 0xF8000B44[6:5] = 0x00000000U
// .. ==> MASK : 0x00000060U VAL : 0x00000000U
// .. IBUF_DISABLE_MODE = 0x0
// .. ==> 0xF8000B44[7:7] = 0x00000000U
// .. ==> MASK : 0x00000080U VAL : 0x00000000U
// .. TERM_DISABLE_MODE = 0x0
// .. ==> 0xF8000B44[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. OUTPUT_EN = 0x3
// .. ==> 0xF8000B44[10:9] = 0x00000003U
// .. ==> MASK : 0x00000600U VAL : 0x00000600U
// .. PULLUP_EN = 0x0
// .. ==> 0xF8000B44[11:11] = 0x00000000U
// .. ==> MASK : 0x00000800U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B44, 0x00000FFF, 0x00000600),
// .. reserved_INP_POWER = 0x0
// .. ==> 0xF8000B48[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. INP_TYPE = 0x1
// .. ==> 0xF8000B48[2:1] = 0x00000001U
// .. ==> MASK : 0x00000006U VAL : 0x00000002U
// .. DCI_UPDATE_B = 0x0
// .. ==> 0xF8000B48[3:3] = 0x00000000U
// .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. TERM_EN = 0x1
// .. ==> 0xF8000B48[4:4] = 0x00000001U
// .. ==> MASK : 0x00000010U VAL : 0x00000010U
// .. DCI_TYPE = 0x3
// .. ==> 0xF8000B48[6:5] = 0x00000003U
// .. ==> MASK : 0x00000060U VAL : 0x00000060U
// .. IBUF_DISABLE_MODE = 0
// .. ==> 0xF8000B48[7:7] = 0x00000000U
// .. ==> MASK : 0x00000080U VAL : 0x00000000U
// .. TERM_DISABLE_MODE = 0
// .. ==> 0xF8000B48[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. OUTPUT_EN = 0x3
// .. ==> 0xF8000B48[10:9] = 0x00000003U
// .. ==> MASK : 0x00000600U VAL : 0x00000600U
// .. PULLUP_EN = 0x0
// .. ==> 0xF8000B48[11:11] = 0x00000000U
// .. ==> MASK : 0x00000800U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B48, 0x00000FFF, 0x00000672),
// .. reserved_INP_POWER = 0x0
// .. ==> 0xF8000B4C[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. INP_TYPE = 0x1
// .. ==> 0xF8000B4C[2:1] = 0x00000001U
// .. ==> MASK : 0x00000006U VAL : 0x00000002U
// .. DCI_UPDATE_B = 0x0
// .. ==> 0xF8000B4C[3:3] = 0x00000000U
// .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. TERM_EN = 0x1
// .. ==> 0xF8000B4C[4:4] = 0x00000001U
// .. ==> MASK : 0x00000010U VAL : 0x00000010U
// .. DCI_TYPE = 0x3
// .. ==> 0xF8000B4C[6:5] = 0x00000003U
// .. ==> MASK : 0x00000060U VAL : 0x00000060U
// .. IBUF_DISABLE_MODE = 0
// .. ==> 0xF8000B4C[7:7] = 0x00000000U
// .. ==> MASK : 0x00000080U VAL : 0x00000000U
// .. TERM_DISABLE_MODE = 0
// .. ==> 0xF8000B4C[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. OUTPUT_EN = 0x3
// .. ==> 0xF8000B4C[10:9] = 0x00000003U
// .. ==> MASK : 0x00000600U VAL : 0x00000600U
// .. PULLUP_EN = 0x0
// .. ==> 0xF8000B4C[11:11] = 0x00000000U
// .. ==> MASK : 0x00000800U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B4C, 0x00000FFF, 0x00000672),
// .. reserved_INP_POWER = 0x0
// .. ==> 0xF8000B50[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. INP_TYPE = 0x2
// .. ==> 0xF8000B50[2:1] = 0x00000002U
// .. ==> MASK : 0x00000006U VAL : 0x00000004U
// .. DCI_UPDATE_B = 0x0
// .. ==> 0xF8000B50[3:3] = 0x00000000U
// .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. TERM_EN = 0x1
// .. ==> 0xF8000B50[4:4] = 0x00000001U
// .. ==> MASK : 0x00000010U VAL : 0x00000010U
// .. DCI_TYPE = 0x3
// .. ==> 0xF8000B50[6:5] = 0x00000003U
// .. ==> MASK : 0x00000060U VAL : 0x00000060U
// .. IBUF_DISABLE_MODE = 0
// .. ==> 0xF8000B50[7:7] = 0x00000000U
// .. ==> MASK : 0x00000080U VAL : 0x00000000U
// .. TERM_DISABLE_MODE = 0
// .. ==> 0xF8000B50[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. OUTPUT_EN = 0x3
// .. ==> 0xF8000B50[10:9] = 0x00000003U
// .. ==> MASK : 0x00000600U VAL : 0x00000600U
// .. PULLUP_EN = 0x0
// .. ==> 0xF8000B50[11:11] = 0x00000000U
// .. ==> MASK : 0x00000800U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B50, 0x00000FFF, 0x00000674),
// .. reserved_INP_POWER = 0x0
// .. ==> 0xF8000B54[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. INP_TYPE = 0x2
// .. ==> 0xF8000B54[2:1] = 0x00000002U
// .. ==> MASK : 0x00000006U VAL : 0x00000004U
// .. DCI_UPDATE_B = 0x0
// .. ==> 0xF8000B54[3:3] = 0x00000000U
// .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. TERM_EN = 0x1
// .. ==> 0xF8000B54[4:4] = 0x00000001U
// .. ==> MASK : 0x00000010U VAL : 0x00000010U
// .. DCI_TYPE = 0x3
// .. ==> 0xF8000B54[6:5] = 0x00000003U
// .. ==> MASK : 0x00000060U VAL : 0x00000060U
// .. IBUF_DISABLE_MODE = 0
// .. ==> 0xF8000B54[7:7] = 0x00000000U
// .. ==> MASK : 0x00000080U VAL : 0x00000000U
// .. TERM_DISABLE_MODE = 0
// .. ==> 0xF8000B54[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. OUTPUT_EN = 0x3
// .. ==> 0xF8000B54[10:9] = 0x00000003U
// .. ==> MASK : 0x00000600U VAL : 0x00000600U
// .. PULLUP_EN = 0x0
// .. ==> 0xF8000B54[11:11] = 0x00000000U
// .. ==> MASK : 0x00000800U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B54, 0x00000FFF, 0x00000674),
// .. reserved_INP_POWER = 0x0
// .. ==> 0xF8000B58[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. INP_TYPE = 0x0
// .. ==> 0xF8000B58[2:1] = 0x00000000U
// .. ==> MASK : 0x00000006U VAL : 0x00000000U
// .. DCI_UPDATE_B = 0x0
// .. ==> 0xF8000B58[3:3] = 0x00000000U
// .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. TERM_EN = 0x0
// .. ==> 0xF8000B58[4:4] = 0x00000000U
// .. ==> MASK : 0x00000010U VAL : 0x00000000U
// .. DCI_TYPE = 0x0
// .. ==> 0xF8000B58[6:5] = 0x00000000U
// .. ==> MASK : 0x00000060U VAL : 0x00000000U
// .. IBUF_DISABLE_MODE = 0x0
// .. ==> 0xF8000B58[7:7] = 0x00000000U
// .. ==> MASK : 0x00000080U VAL : 0x00000000U
// .. TERM_DISABLE_MODE = 0x0
// .. ==> 0xF8000B58[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. OUTPUT_EN = 0x3
// .. ==> 0xF8000B58[10:9] = 0x00000003U
// .. ==> MASK : 0x00000600U VAL : 0x00000600U
// .. PULLUP_EN = 0x0
// .. ==> 0xF8000B58[11:11] = 0x00000000U
// .. ==> MASK : 0x00000800U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B58, 0x00000FFF, 0x00000600),
// .. reserved_DRIVE_P = 0x1c
// .. ==> 0xF8000B5C[6:0] = 0x0000001CU
// .. ==> MASK : 0x0000007FU VAL : 0x0000001CU
// .. reserved_DRIVE_N = 0xc
// .. ==> 0xF8000B5C[13:7] = 0x0000000CU
// .. ==> MASK : 0x00003F80U VAL : 0x00000600U
// .. reserved_SLEW_P = 0x3
// .. ==> 0xF8000B5C[18:14] = 0x00000003U
// .. ==> MASK : 0x0007C000U VAL : 0x0000C000U
// .. reserved_SLEW_N = 0x3
// .. ==> 0xF8000B5C[23:19] = 0x00000003U
// .. ==> MASK : 0x00F80000U VAL : 0x00180000U
// .. reserved_GTL = 0x0
// .. ==> 0xF8000B5C[26:24] = 0x00000000U
// .. ==> MASK : 0x07000000U VAL : 0x00000000U
// .. reserved_RTERM = 0x0
// .. ==> 0xF8000B5C[31:27] = 0x00000000U
// .. ==> MASK : 0xF8000000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B5C, 0xFFFFFFFF, 0x0018C61C),
// .. reserved_DRIVE_P = 0x1c
// .. ==> 0xF8000B60[6:0] = 0x0000001CU
// .. ==> MASK : 0x0000007FU VAL : 0x0000001CU
// .. reserved_DRIVE_N = 0xc
// .. ==> 0xF8000B60[13:7] = 0x0000000CU
// .. ==> MASK : 0x00003F80U VAL : 0x00000600U
// .. reserved_SLEW_P = 0x6
// .. ==> 0xF8000B60[18:14] = 0x00000006U
// .. ==> MASK : 0x0007C000U VAL : 0x00018000U
// .. reserved_SLEW_N = 0x1f
// .. ==> 0xF8000B60[23:19] = 0x0000001FU
// .. ==> MASK : 0x00F80000U VAL : 0x00F80000U
// .. reserved_GTL = 0x0
// .. ==> 0xF8000B60[26:24] = 0x00000000U
// .. ==> MASK : 0x07000000U VAL : 0x00000000U
// .. reserved_RTERM = 0x0
// .. ==> 0xF8000B60[31:27] = 0x00000000U
// .. ==> MASK : 0xF8000000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B60, 0xFFFFFFFF, 0x00F9861C),
// .. reserved_DRIVE_P = 0x1c
// .. ==> 0xF8000B64[6:0] = 0x0000001CU
// .. ==> MASK : 0x0000007FU VAL : 0x0000001CU
// .. reserved_DRIVE_N = 0xc
// .. ==> 0xF8000B64[13:7] = 0x0000000CU
// .. ==> MASK : 0x00003F80U VAL : 0x00000600U
// .. reserved_SLEW_P = 0x6
// .. ==> 0xF8000B64[18:14] = 0x00000006U
// .. ==> MASK : 0x0007C000U VAL : 0x00018000U
// .. reserved_SLEW_N = 0x1f
// .. ==> 0xF8000B64[23:19] = 0x0000001FU
// .. ==> MASK : 0x00F80000U VAL : 0x00F80000U
// .. reserved_GTL = 0x0
// .. ==> 0xF8000B64[26:24] = 0x00000000U
// .. ==> MASK : 0x07000000U VAL : 0x00000000U
// .. reserved_RTERM = 0x0
// .. ==> 0xF8000B64[31:27] = 0x00000000U
// .. ==> MASK : 0xF8000000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B64, 0xFFFFFFFF, 0x00F9861C),
// .. reserved_DRIVE_P = 0x1c
// .. ==> 0xF8000B68[6:0] = 0x0000001CU
// .. ==> MASK : 0x0000007FU VAL : 0x0000001CU
// .. reserved_DRIVE_N = 0xc
// .. ==> 0xF8000B68[13:7] = 0x0000000CU
// .. ==> MASK : 0x00003F80U VAL : 0x00000600U
// .. reserved_SLEW_P = 0x6
// .. ==> 0xF8000B68[18:14] = 0x00000006U
// .. ==> MASK : 0x0007C000U VAL : 0x00018000U
// .. reserved_SLEW_N = 0x1f
// .. ==> 0xF8000B68[23:19] = 0x0000001FU
// .. ==> MASK : 0x00F80000U VAL : 0x00F80000U
// .. reserved_GTL = 0x0
// .. ==> 0xF8000B68[26:24] = 0x00000000U
// .. ==> MASK : 0x07000000U VAL : 0x00000000U
// .. reserved_RTERM = 0x0
// .. ==> 0xF8000B68[31:27] = 0x00000000U
// .. ==> MASK : 0xF8000000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B68, 0xFFFFFFFF, 0x00F9861C),
// .. VREF_INT_EN = 0x1
// .. ==> 0xF8000B6C[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. VREF_SEL = 0x4
// .. ==> 0xF8000B6C[4:1] = 0x00000004U
// .. ==> MASK : 0x0000001EU VAL : 0x00000008U
// .. VREF_EXT_EN = 0x0
// .. ==> 0xF8000B6C[6:5] = 0x00000000U
// .. ==> MASK : 0x00000060U VAL : 0x00000000U
// .. reserved_VREF_PULLUP_EN = 0x0
// .. ==> 0xF8000B6C[8:7] = 0x00000000U
// .. ==> MASK : 0x00000180U VAL : 0x00000000U
// .. REFIO_EN = 0x1
// .. ==> 0xF8000B6C[9:9] = 0x00000001U
// .. ==> MASK : 0x00000200U VAL : 0x00000200U
// .. reserved_REFIO_TEST = 0x3
// .. ==> 0xF8000B6C[11:10] = 0x00000003U
// .. ==> MASK : 0x00000C00U VAL : 0x00000C00U
// .. reserved_REFIO_PULLUP_EN = 0x0
// .. ==> 0xF8000B6C[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. reserved_DRST_B_PULLUP_EN = 0x0
// .. ==> 0xF8000B6C[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// .. reserved_CKE_PULLUP_EN = 0x0
// .. ==> 0xF8000B6C[14:14] = 0x00000000U
// .. ==> MASK : 0x00004000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000B6C, 0x00007FFF, 0x00000E09),
// .. .. START: ASSERT RESET
// .. .. RESET = 1
// .. .. ==> 0xF8000B70[0:0] = 0x00000001U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. ..
MaskWrite(0xF8000B70, 0x00000001, 0x00000001),
// .. .. FINISH: ASSERT RESET
// .. .. START: DEASSERT RESET
// .. .. RESET = 0
// .. .. ==> 0xF8000B70[0:0] = 0x00000000U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. reserved_VRN_OUT = 0x1
// .. .. ==> 0xF8000B70[5:5] = 0x00000001U
// .. .. ==> MASK : 0x00000020U VAL : 0x00000020U
// .. ..
MaskWrite(0xF8000B70, 0x00000021, 0x00000020),
// .. .. FINISH: DEASSERT RESET
// .. .. RESET = 0x1
// .. .. ==> 0xF8000B70[0:0] = 0x00000001U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. ENABLE = 0x1
// .. .. ==> 0xF8000B70[1:1] = 0x00000001U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. .. reserved_VRP_TRI = 0x0
// .. .. ==> 0xF8000B70[2:2] = 0x00000000U
// .. .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. .. reserved_VRN_TRI = 0x0
// .. .. ==> 0xF8000B70[3:3] = 0x00000000U
// .. .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. .. reserved_VRP_OUT = 0x0
// .. .. ==> 0xF8000B70[4:4] = 0x00000000U
// .. .. ==> MASK : 0x00000010U VAL : 0x00000000U
// .. .. reserved_VRN_OUT = 0x1
// .. .. ==> 0xF8000B70[5:5] = 0x00000001U
// .. .. ==> MASK : 0x00000020U VAL : 0x00000020U
// .. .. NREF_OPT1 = 0x0
// .. .. ==> 0xF8000B70[7:6] = 0x00000000U
// .. .. ==> MASK : 0x000000C0U VAL : 0x00000000U
// .. .. NREF_OPT2 = 0x0
// .. .. ==> 0xF8000B70[10:8] = 0x00000000U
// .. .. ==> MASK : 0x00000700U VAL : 0x00000000U
// .. .. NREF_OPT4 = 0x1
// .. .. ==> 0xF8000B70[13:11] = 0x00000001U
// .. .. ==> MASK : 0x00003800U VAL : 0x00000800U
// .. .. PREF_OPT1 = 0x0
// .. .. ==> 0xF8000B70[15:14] = 0x00000000U
// .. .. ==> MASK : 0x0000C000U VAL : 0x00000000U
// .. .. PREF_OPT2 = 0x0
// .. .. ==> 0xF8000B70[19:17] = 0x00000000U
// .. .. ==> MASK : 0x000E0000U VAL : 0x00000000U
// .. .. UPDATE_CONTROL = 0x0
// .. .. ==> 0xF8000B70[20:20] = 0x00000000U
// .. .. ==> MASK : 0x00100000U VAL : 0x00000000U
// .. .. reserved_INIT_COMPLETE = 0x0
// .. .. ==> 0xF8000B70[21:21] = 0x00000000U
// .. .. ==> MASK : 0x00200000U VAL : 0x00000000U
// .. .. reserved_TST_CLK = 0x0
// .. .. ==> 0xF8000B70[22:22] = 0x00000000U
// .. .. ==> MASK : 0x00400000U VAL : 0x00000000U
// .. .. reserved_TST_HLN = 0x0
// .. .. ==> 0xF8000B70[23:23] = 0x00000000U
// .. .. ==> MASK : 0x00800000U VAL : 0x00000000U
// .. .. reserved_TST_HLP = 0x0
// .. .. ==> 0xF8000B70[24:24] = 0x00000000U
// .. .. ==> MASK : 0x01000000U VAL : 0x00000000U
// .. .. reserved_TST_RST = 0x0
// .. .. ==> 0xF8000B70[25:25] = 0x00000000U
// .. .. ==> MASK : 0x02000000U VAL : 0x00000000U
// .. .. reserved_INT_DCI_EN = 0x0
// .. .. ==> 0xF8000B70[26:26] = 0x00000000U
// .. .. ==> MASK : 0x04000000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8000B70, 0x07FEFFFF, 0x00000823),
// .. FINISH: DDRIOB SETTINGS
// .. START: MIO PROGRAMMING
// .. TRI_ENABLE = 1
// .. ==> 0xF8000700[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. Speed = 0
// .. ==> 0xF8000700[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000700[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF8000700[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF8000700[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000700, 0x00003F01, 0x00001201),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000704[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF8000704[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000704[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000704[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000704[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000704[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000704[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF8000704[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF8000704[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000704, 0x00003FFF, 0x00001202),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000708[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF8000708[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000708[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000708[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000708[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000708[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000708[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000708[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000708[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000708, 0x00003FFF, 0x00000202),
// .. TRI_ENABLE = 0
// .. ==> 0xF800070C[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF800070C[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF800070C[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF800070C[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF800070C[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF800070C[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF800070C[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF800070C[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF800070C[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF800070C, 0x00003FFF, 0x00000202),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000710[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF8000710[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000710[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000710[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000710[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000710[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000710[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000710[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000710[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000710, 0x00003FFF, 0x00000202),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000714[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF8000714[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000714[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000714[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000714[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000714[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000714[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000714[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000714[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000714, 0x00003FFF, 0x00000202),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000718[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF8000718[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000718[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000718[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000718[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000718[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000718[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000718[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000718[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000718, 0x00003FFF, 0x00000202),
// .. TRI_ENABLE = 0
// .. ==> 0xF800071C[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF800071C[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF800071C[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF800071C[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF800071C[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF800071C[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF800071C[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF800071C[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF800071C[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF800071C, 0x00003FFF, 0x00000200),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000720[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF8000720[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000720[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000720[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000720[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000720[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000720[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000720[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000720[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000720, 0x00003FFF, 0x00000202),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000724[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000724[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF8000724[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000724[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000724[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000724[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000724[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF8000724[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF8000724[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000724, 0x00003FFF, 0x00001200),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000728[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000728[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF8000728[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000728[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000728[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000728[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000728[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF8000728[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF8000728[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000728, 0x00003FFF, 0x00001200),
// .. TRI_ENABLE = 0
// .. ==> 0xF800072C[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF800072C[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF800072C[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF800072C[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF800072C[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF800072C[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF800072C[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF800072C[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF800072C[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF800072C, 0x00003FFF, 0x00001200),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000730[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000730[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF8000730[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000730[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000730[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000730[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000730[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF8000730[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF8000730[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000730, 0x00003FFF, 0x00001200),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000734[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000734[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF8000734[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000734[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000734[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000734[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000734[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF8000734[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF8000734[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000734, 0x00003FFF, 0x00001200),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000738[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000738[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF8000738[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000738[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000738[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000738[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000738[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF8000738[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF8000738[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000738, 0x00003FFF, 0x00001200),
// .. TRI_ENABLE = 1
// .. ==> 0xF800073C[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. Speed = 0
// .. ==> 0xF800073C[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF800073C[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF800073C[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF800073C[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF800073C, 0x00003F01, 0x00001201),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000740[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF8000740[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000740[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000740[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000740[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000740[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF8000740[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF8000740[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 1
// .. ==> 0xF8000740[13:13] = 0x00000001U
// .. ==> MASK : 0x00002000U VAL : 0x00002000U
// ..
MaskWrite(0xF8000740, 0x00003FFF, 0x00002802),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000744[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF8000744[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000744[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000744[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000744[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000744[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF8000744[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF8000744[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 1
// .. ==> 0xF8000744[13:13] = 0x00000001U
// .. ==> MASK : 0x00002000U VAL : 0x00002000U
// ..
MaskWrite(0xF8000744, 0x00003FFF, 0x00002802),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000748[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF8000748[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000748[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000748[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000748[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000748[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF8000748[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF8000748[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 1
// .. ==> 0xF8000748[13:13] = 0x00000001U
// .. ==> MASK : 0x00002000U VAL : 0x00002000U
// ..
MaskWrite(0xF8000748, 0x00003FFF, 0x00002802),
// .. TRI_ENABLE = 0
// .. ==> 0xF800074C[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF800074C[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF800074C[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF800074C[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF800074C[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF800074C[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF800074C[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF800074C[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 1
// .. ==> 0xF800074C[13:13] = 0x00000001U
// .. ==> MASK : 0x00002000U VAL : 0x00002000U
// ..
MaskWrite(0xF800074C, 0x00003FFF, 0x00002802),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000750[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF8000750[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000750[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000750[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000750[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000750[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF8000750[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF8000750[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 1
// .. ==> 0xF8000750[13:13] = 0x00000001U
// .. ==> MASK : 0x00002000U VAL : 0x00002000U
// ..
MaskWrite(0xF8000750, 0x00003FFF, 0x00002802),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000754[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 1
// .. ==> 0xF8000754[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000754[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000754[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000754[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000754[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF8000754[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF8000754[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 1
// .. ==> 0xF8000754[13:13] = 0x00000001U
// .. ==> MASK : 0x00002000U VAL : 0x00002000U
// ..
MaskWrite(0xF8000754, 0x00003FFF, 0x00002802),
// .. TRI_ENABLE = 1
// .. ==> 0xF8000758[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. L0_SEL = 1
// .. ==> 0xF8000758[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000758[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000758[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000758[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000758[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF8000758[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF8000758[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000758[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000758, 0x00003FFF, 0x00000803),
// .. TRI_ENABLE = 1
// .. ==> 0xF800075C[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. L0_SEL = 1
// .. ==> 0xF800075C[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF800075C[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF800075C[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF800075C[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF800075C[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF800075C[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF800075C[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF800075C[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF800075C, 0x00003FFF, 0x00000803),
// .. TRI_ENABLE = 1
// .. ==> 0xF8000760[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. L0_SEL = 1
// .. ==> 0xF8000760[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000760[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000760[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000760[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000760[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF8000760[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF8000760[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000760[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000760, 0x00003FFF, 0x00000803),
// .. TRI_ENABLE = 1
// .. ==> 0xF8000764[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. L0_SEL = 1
// .. ==> 0xF8000764[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000764[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000764[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000764[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000764[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF8000764[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF8000764[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000764[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000764, 0x00003FFF, 0x00000803),
// .. TRI_ENABLE = 1
// .. ==> 0xF8000768[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. L0_SEL = 1
// .. ==> 0xF8000768[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF8000768[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF8000768[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000768[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000768[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF8000768[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF8000768[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000768[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000768, 0x00003FFF, 0x00000803),
// .. TRI_ENABLE = 1
// .. ==> 0xF800076C[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. L0_SEL = 1
// .. ==> 0xF800076C[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. L1_SEL = 0
// .. ==> 0xF800076C[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF800076C[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF800076C[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF800076C[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 4
// .. ==> 0xF800076C[11:9] = 0x00000004U
// .. ==> MASK : 0x00000E00U VAL : 0x00000800U
// .. PULLUP = 0
// .. ==> 0xF800076C[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF800076C[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF800076C, 0x00003FFF, 0x00000803),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000770[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000770[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF8000770[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF8000770[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000770[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000770[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000770[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000770[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000770[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000770, 0x00003FFF, 0x00000204),
// .. TRI_ENABLE = 1
// .. ==> 0xF8000774[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. L0_SEL = 0
// .. ==> 0xF8000774[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF8000774[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF8000774[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000774[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000774[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000774[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000774[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000774[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000774, 0x00003FFF, 0x00000205),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000778[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000778[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF8000778[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF8000778[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000778[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000778[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000778[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000778[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000778[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000778, 0x00003FFF, 0x00000204),
// .. TRI_ENABLE = 1
// .. ==> 0xF800077C[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. L0_SEL = 0
// .. ==> 0xF800077C[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF800077C[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF800077C[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF800077C[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF800077C[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF800077C[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF800077C[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF800077C[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF800077C, 0x00003FFF, 0x00000205),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000780[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000780[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF8000780[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF8000780[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000780[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000780[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000780[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000780[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000780[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000780, 0x00003FFF, 0x00000204),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000784[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000784[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF8000784[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF8000784[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000784[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000784[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000784[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000784[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000784[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000784, 0x00003FFF, 0x00000204),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000788[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000788[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF8000788[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF8000788[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000788[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000788[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000788[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000788[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000788[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000788, 0x00003FFF, 0x00000204),
// .. TRI_ENABLE = 0
// .. ==> 0xF800078C[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF800078C[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF800078C[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF800078C[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF800078C[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF800078C[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF800078C[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF800078C[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF800078C[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF800078C, 0x00003FFF, 0x00000204),
// .. TRI_ENABLE = 1
// .. ==> 0xF8000790[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. L0_SEL = 0
// .. ==> 0xF8000790[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF8000790[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF8000790[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000790[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000790[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000790[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000790[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000790[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000790, 0x00003FFF, 0x00000205),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000794[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000794[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF8000794[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF8000794[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000794[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000794[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000794[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000794[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000794[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000794, 0x00003FFF, 0x00000204),
// .. TRI_ENABLE = 0
// .. ==> 0xF8000798[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF8000798[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF8000798[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF8000798[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF8000798[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF8000798[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF8000798[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF8000798[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF8000798[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000798, 0x00003FFF, 0x00000204),
// .. TRI_ENABLE = 0
// .. ==> 0xF800079C[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF800079C[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 1
// .. ==> 0xF800079C[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. L2_SEL = 0
// .. ==> 0xF800079C[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 0
// .. ==> 0xF800079C[7:5] = 0x00000000U
// .. ==> MASK : 0x000000E0U VAL : 0x00000000U
// .. Speed = 0
// .. ==> 0xF800079C[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF800079C[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF800079C[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF800079C[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF800079C, 0x00003FFF, 0x00000204),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007A0[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007A0[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007A0[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007A0[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 4
// .. ==> 0xF80007A0[7:5] = 0x00000004U
// .. ==> MASK : 0x000000E0U VAL : 0x00000080U
// .. Speed = 0
// .. ==> 0xF80007A0[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007A0[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF80007A0[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF80007A0[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007A0, 0x00003FFF, 0x00000280),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007A4[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007A4[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007A4[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007A4[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 4
// .. ==> 0xF80007A4[7:5] = 0x00000004U
// .. ==> MASK : 0x000000E0U VAL : 0x00000080U
// .. Speed = 0
// .. ==> 0xF80007A4[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007A4[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF80007A4[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF80007A4[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007A4, 0x00003FFF, 0x00000280),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007A8[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007A8[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007A8[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007A8[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 4
// .. ==> 0xF80007A8[7:5] = 0x00000004U
// .. ==> MASK : 0x000000E0U VAL : 0x00000080U
// .. Speed = 0
// .. ==> 0xF80007A8[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007A8[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF80007A8[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF80007A8[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007A8, 0x00003FFF, 0x00000280),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007AC[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007AC[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007AC[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007AC[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 4
// .. ==> 0xF80007AC[7:5] = 0x00000004U
// .. ==> MASK : 0x000000E0U VAL : 0x00000080U
// .. Speed = 0
// .. ==> 0xF80007AC[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007AC[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF80007AC[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF80007AC[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007AC, 0x00003FFF, 0x00000280),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007B0[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007B0[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007B0[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007B0[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 4
// .. ==> 0xF80007B0[7:5] = 0x00000004U
// .. ==> MASK : 0x000000E0U VAL : 0x00000080U
// .. Speed = 0
// .. ==> 0xF80007B0[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007B0[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF80007B0[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF80007B0[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007B0, 0x00003FFF, 0x00000280),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007B4[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007B4[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007B4[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007B4[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 4
// .. ==> 0xF80007B4[7:5] = 0x00000004U
// .. ==> MASK : 0x000000E0U VAL : 0x00000080U
// .. Speed = 0
// .. ==> 0xF80007B4[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007B4[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF80007B4[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF80007B4[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007B4, 0x00003FFF, 0x00000280),
// .. TRI_ENABLE = 1
// .. ==> 0xF80007B8[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. L0_SEL = 0
// .. ==> 0xF80007B8[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007B8[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007B8[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 1
// .. ==> 0xF80007B8[7:5] = 0x00000001U
// .. ==> MASK : 0x000000E0U VAL : 0x00000020U
// .. Speed = 0
// .. ==> 0xF80007B8[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007B8[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF80007B8[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF80007B8[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007B8, 0x00003FFF, 0x00001221),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007BC[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007BC[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007BC[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007BC[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 1
// .. ==> 0xF80007BC[7:5] = 0x00000001U
// .. ==> MASK : 0x000000E0U VAL : 0x00000020U
// .. Speed = 0
// .. ==> 0xF80007BC[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007BC[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF80007BC[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF80007BC[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007BC, 0x00003FFF, 0x00001220),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007C0[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007C0[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007C0[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007C0[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 7
// .. ==> 0xF80007C0[7:5] = 0x00000007U
// .. ==> MASK : 0x000000E0U VAL : 0x000000E0U
// .. Speed = 0
// .. ==> 0xF80007C0[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007C0[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF80007C0[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF80007C0[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007C0, 0x00003FFF, 0x000002E0),
// .. TRI_ENABLE = 1
// .. ==> 0xF80007C4[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. L0_SEL = 0
// .. ==> 0xF80007C4[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007C4[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007C4[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 7
// .. ==> 0xF80007C4[7:5] = 0x00000007U
// .. ==> MASK : 0x000000E0U VAL : 0x000000E0U
// .. Speed = 0
// .. ==> 0xF80007C4[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007C4[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF80007C4[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF80007C4[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007C4, 0x00003FFF, 0x000002E1),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007C8[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007C8[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007C8[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007C8[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 2
// .. ==> 0xF80007C8[7:5] = 0x00000002U
// .. ==> MASK : 0x000000E0U VAL : 0x00000040U
// .. Speed = 0
// .. ==> 0xF80007C8[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007C8[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF80007C8[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF80007C8[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007C8, 0x00003FFF, 0x00001240),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007CC[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007CC[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007CC[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007CC[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 2
// .. ==> 0xF80007CC[7:5] = 0x00000002U
// .. ==> MASK : 0x000000E0U VAL : 0x00000040U
// .. Speed = 0
// .. ==> 0xF80007CC[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007CC[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 1
// .. ==> 0xF80007CC[12:12] = 0x00000001U
// .. ==> MASK : 0x00001000U VAL : 0x00001000U
// .. DisableRcvr = 0
// .. ==> 0xF80007CC[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007CC, 0x00003FFF, 0x00001240),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007D0[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007D0[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007D0[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007D0[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 4
// .. ==> 0xF80007D0[7:5] = 0x00000004U
// .. ==> MASK : 0x000000E0U VAL : 0x00000080U
// .. Speed = 0
// .. ==> 0xF80007D0[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007D0[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF80007D0[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF80007D0[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007D0, 0x00003FFF, 0x00000280),
// .. TRI_ENABLE = 0
// .. ==> 0xF80007D4[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. L0_SEL = 0
// .. ==> 0xF80007D4[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. L1_SEL = 0
// .. ==> 0xF80007D4[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. L2_SEL = 0
// .. ==> 0xF80007D4[4:3] = 0x00000000U
// .. ==> MASK : 0x00000018U VAL : 0x00000000U
// .. L3_SEL = 4
// .. ==> 0xF80007D4[7:5] = 0x00000004U
// .. ==> MASK : 0x000000E0U VAL : 0x00000080U
// .. Speed = 0
// .. ==> 0xF80007D4[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. IO_Type = 1
// .. ==> 0xF80007D4[11:9] = 0x00000001U
// .. ==> MASK : 0x00000E00U VAL : 0x00000200U
// .. PULLUP = 0
// .. ==> 0xF80007D4[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. DisableRcvr = 0
// .. ==> 0xF80007D4[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// ..
MaskWrite(0xF80007D4, 0x00003FFF, 0x00000280),
// .. SDIO0_WP_SEL = 15
// .. ==> 0xF8000830[5:0] = 0x0000000FU
// .. ==> MASK : 0x0000003FU VAL : 0x0000000FU
// .. SDIO0_CD_SEL = 0
// .. ==> 0xF8000830[21:16] = 0x00000000U
// .. ==> MASK : 0x003F0000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000830, 0x003F003F, 0x0000000F),
// .. FINISH: MIO PROGRAMMING
// .. START: LOCK IT BACK
// .. LOCK_KEY = 0x767B
// .. ==> 0xF8000004[15:0] = 0x0000767BU
// .. ==> MASK : 0x0000FFFFU VAL : 0x0000767BU
// ..
MaskWrite(0xF8000004, 0x0000FFFF, 0x0000767B),
// .. FINISH: LOCK IT BACK
// FINISH: top
// *** ps7_pll_init_data_3_0 ***
// START: top
// .. START: SLCR SETTINGS
// .. UNLOCK_KEY = 0xDF0D
// .. ==> 0xF8000008[15:0] = 0x0000DF0DU
// .. ==> MASK : 0x0000FFFFU VAL : 0x0000DF0DU
// ..
MaskWrite(0xF8000008, 0x0000FFFF, 0x0000DF0D),
// .. FINISH: SLCR SETTINGS
// .. START: PLL SLCR REGISTERS
// .. .. START: ARM PLL INIT
// .. .. PLL_RES = 0x2
// .. .. ==> 0xF8000110[7:4] = 0x00000002U
// .. .. ==> MASK : 0x000000F0U VAL : 0x00000020U
// .. .. PLL_CP = 0x2
// .. .. ==> 0xF8000110[11:8] = 0x00000002U
// .. .. ==> MASK : 0x00000F00U VAL : 0x00000200U
// .. .. LOCK_CNT = 0xfa
// .. .. ==> 0xF8000110[21:12] = 0x000000FAU
// .. .. ==> MASK : 0x003FF000U VAL : 0x000FA000U
// .. ..
MaskWrite(0xF8000110, 0x003FFFF0, 0x000FA220),
// .. .. .. START: UPDATE FB_DIV
// .. .. .. PLL_FDIV = 0x28
// .. .. .. ==> 0xF8000100[18:12] = 0x00000028U
// .. .. .. ==> MASK : 0x0007F000U VAL : 0x00028000U
// .. .. ..
MaskWrite(0xF8000100, 0x0007F000, 0x00028000),
// .. .. .. FINISH: UPDATE FB_DIV
// .. .. .. START: BY PASS PLL
// .. .. .. PLL_BYPASS_FORCE = 1
// .. .. .. ==> 0xF8000100[4:4] = 0x00000001U
// .. .. .. ==> MASK : 0x00000010U VAL : 0x00000010U
// .. .. ..
MaskWrite(0xF8000100, 0x00000010, 0x00000010),
// .. .. .. FINISH: BY PASS PLL
// .. .. .. START: ASSERT RESET
// .. .. .. PLL_RESET = 1
// .. .. .. ==> 0xF8000100[0:0] = 0x00000001U
// .. .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. ..
MaskWrite(0xF8000100, 0x00000001, 0x00000001),
// .. .. .. FINISH: ASSERT RESET
// .. .. .. START: DEASSERT RESET
// .. .. .. PLL_RESET = 0
// .. .. .. ==> 0xF8000100[0:0] = 0x00000000U
// .. .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. ..
MaskWrite(0xF8000100, 0x00000001, 0x00000000),
// .. .. .. FINISH: DEASSERT RESET
// .. .. .. START: CHECK PLL STATUS
// .. .. .. ARM_PLL_LOCK = 1
// .. .. .. ==> 0xF800010C[0:0] = 0x00000001U
// .. .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. ..
MaskPoll(0xF800010C, 0x00000001),
// .. .. .. FINISH: CHECK PLL STATUS
// .. .. .. START: REMOVE PLL BY PASS
// .. .. .. PLL_BYPASS_FORCE = 0
// .. .. .. ==> 0xF8000100[4:4] = 0x00000000U
// .. .. .. ==> MASK : 0x00000010U VAL : 0x00000000U
// .. .. ..
MaskWrite(0xF8000100, 0x00000010, 0x00000000),
// .. .. .. FINISH: REMOVE PLL BY PASS
// .. .. .. SRCSEL = 0x0
// .. .. .. ==> 0xF8000120[5:4] = 0x00000000U
// .. .. .. ==> MASK : 0x00000030U VAL : 0x00000000U
// .. .. .. DIVISOR = 0x2
// .. .. .. ==> 0xF8000120[13:8] = 0x00000002U
// .. .. .. ==> MASK : 0x00003F00U VAL : 0x00000200U
// .. .. .. CPU_6OR4XCLKACT = 0x1
// .. .. .. ==> 0xF8000120[24:24] = 0x00000001U
// .. .. .. ==> MASK : 0x01000000U VAL : 0x01000000U
// .. .. .. CPU_3OR2XCLKACT = 0x1
// .. .. .. ==> 0xF8000120[25:25] = 0x00000001U
// .. .. .. ==> MASK : 0x02000000U VAL : 0x02000000U
// .. .. .. CPU_2XCLKACT = 0x1
// .. .. .. ==> 0xF8000120[26:26] = 0x00000001U
// .. .. .. ==> MASK : 0x04000000U VAL : 0x04000000U
// .. .. .. CPU_1XCLKACT = 0x1
// .. .. .. ==> 0xF8000120[27:27] = 0x00000001U
// .. .. .. ==> MASK : 0x08000000U VAL : 0x08000000U
// .. .. .. CPU_PERI_CLKACT = 0x1
// .. .. .. ==> 0xF8000120[28:28] = 0x00000001U
// .. .. .. ==> MASK : 0x10000000U VAL : 0x10000000U
// .. .. ..
MaskWrite(0xF8000120, 0x1F003F30, 0x1F000200),
// .. .. FINISH: ARM PLL INIT
// .. .. START: DDR PLL INIT
// .. .. PLL_RES = 0x2
// .. .. ==> 0xF8000114[7:4] = 0x00000002U
// .. .. ==> MASK : 0x000000F0U VAL : 0x00000020U
// .. .. PLL_CP = 0x2
// .. .. ==> 0xF8000114[11:8] = 0x00000002U
// .. .. ==> MASK : 0x00000F00U VAL : 0x00000200U
// .. .. LOCK_CNT = 0x12c
// .. .. ==> 0xF8000114[21:12] = 0x0000012CU
// .. .. ==> MASK : 0x003FF000U VAL : 0x0012C000U
// .. ..
MaskWrite(0xF8000114, 0x003FFFF0, 0x0012C220),
// .. .. .. START: UPDATE FB_DIV
// .. .. .. PLL_FDIV = 0x20
// .. .. .. ==> 0xF8000104[18:12] = 0x00000020U
// .. .. .. ==> MASK : 0x0007F000U VAL : 0x00020000U
// .. .. ..
MaskWrite(0xF8000104, 0x0007F000, 0x00020000),
// .. .. .. FINISH: UPDATE FB_DIV
// .. .. .. START: BY PASS PLL
// .. .. .. PLL_BYPASS_FORCE = 1
// .. .. .. ==> 0xF8000104[4:4] = 0x00000001U
// .. .. .. ==> MASK : 0x00000010U VAL : 0x00000010U
// .. .. ..
MaskWrite(0xF8000104, 0x00000010, 0x00000010),
// .. .. .. FINISH: BY PASS PLL
// .. .. .. START: ASSERT RESET
// .. .. .. PLL_RESET = 1
// .. .. .. ==> 0xF8000104[0:0] = 0x00000001U
// .. .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. ..
MaskWrite(0xF8000104, 0x00000001, 0x00000001),
// .. .. .. FINISH: ASSERT RESET
// .. .. .. START: DEASSERT RESET
// .. .. .. PLL_RESET = 0
// .. .. .. ==> 0xF8000104[0:0] = 0x00000000U
// .. .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. ..
MaskWrite(0xF8000104, 0x00000001, 0x00000000),
// .. .. .. FINISH: DEASSERT RESET
// .. .. .. START: CHECK PLL STATUS
// .. .. .. DDR_PLL_LOCK = 1
// .. .. .. ==> 0xF800010C[1:1] = 0x00000001U
// .. .. .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. .. ..
MaskPoll(0xF800010C, 0x00000002),
// .. .. .. FINISH: CHECK PLL STATUS
// .. .. .. START: REMOVE PLL BY PASS
// .. .. .. PLL_BYPASS_FORCE = 0
// .. .. .. ==> 0xF8000104[4:4] = 0x00000000U
// .. .. .. ==> MASK : 0x00000010U VAL : 0x00000000U
// .. .. ..
MaskWrite(0xF8000104, 0x00000010, 0x00000000),
// .. .. .. FINISH: REMOVE PLL BY PASS
// .. .. .. DDR_3XCLKACT = 0x1
// .. .. .. ==> 0xF8000124[0:0] = 0x00000001U
// .. .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. .. DDR_2XCLKACT = 0x1
// .. .. .. ==> 0xF8000124[1:1] = 0x00000001U
// .. .. .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. .. .. DDR_3XCLK_DIVISOR = 0x2
// .. .. .. ==> 0xF8000124[25:20] = 0x00000002U
// .. .. .. ==> MASK : 0x03F00000U VAL : 0x00200000U
// .. .. .. DDR_2XCLK_DIVISOR = 0x3
// .. .. .. ==> 0xF8000124[31:26] = 0x00000003U
// .. .. .. ==> MASK : 0xFC000000U VAL : 0x0C000000U
// .. .. ..
MaskWrite(0xF8000124, 0xFFF00003, 0x0C200003),
// .. .. FINISH: DDR PLL INIT
// .. .. START: IO PLL INIT
// .. .. PLL_RES = 0xc
// .. .. ==> 0xF8000118[7:4] = 0x0000000CU
// .. .. ==> MASK : 0x000000F0U VAL : 0x000000C0U
// .. .. PLL_CP = 0x2
// .. .. ==> 0xF8000118[11:8] = 0x00000002U
// .. .. ==> MASK : 0x00000F00U VAL : 0x00000200U
// .. .. LOCK_CNT = 0x145
// .. .. ==> 0xF8000118[21:12] = 0x00000145U
// .. .. ==> MASK : 0x003FF000U VAL : 0x00145000U
// .. ..
MaskWrite(0xF8000118, 0x003FFFF0, 0x001452C0),
// .. .. .. START: UPDATE FB_DIV
// .. .. .. PLL_FDIV = 0x1e
// .. .. .. ==> 0xF8000108[18:12] = 0x0000001EU
// .. .. .. ==> MASK : 0x0007F000U VAL : 0x0001E000U
// .. .. ..
MaskWrite(0xF8000108, 0x0007F000, 0x0001E000),
// .. .. .. FINISH: UPDATE FB_DIV
// .. .. .. START: BY PASS PLL
// .. .. .. PLL_BYPASS_FORCE = 1
// .. .. .. ==> 0xF8000108[4:4] = 0x00000001U
// .. .. .. ==> MASK : 0x00000010U VAL : 0x00000010U
// .. .. ..
MaskWrite(0xF8000108, 0x00000010, 0x00000010),
// .. .. .. FINISH: BY PASS PLL
// .. .. .. START: ASSERT RESET
// .. .. .. PLL_RESET = 1
// .. .. .. ==> 0xF8000108[0:0] = 0x00000001U
// .. .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. ..
MaskWrite(0xF8000108, 0x00000001, 0x00000001),
// .. .. .. FINISH: ASSERT RESET
// .. .. .. START: DEASSERT RESET
// .. .. .. PLL_RESET = 0
// .. .. .. ==> 0xF8000108[0:0] = 0x00000000U
// .. .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. ..
MaskWrite(0xF8000108, 0x00000001, 0x00000000),
// .. .. .. FINISH: DEASSERT RESET
// .. .. .. START: CHECK PLL STATUS
// .. .. .. IO_PLL_LOCK = 1
// .. .. .. ==> 0xF800010C[2:2] = 0x00000001U
// .. .. .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. .. ..
MaskPoll(0xF800010C, 0x00000004),
// .. .. .. FINISH: CHECK PLL STATUS
// .. .. .. START: REMOVE PLL BY PASS
// .. .. .. PLL_BYPASS_FORCE = 0
// .. .. .. ==> 0xF8000108[4:4] = 0x00000000U
// .. .. .. ==> MASK : 0x00000010U VAL : 0x00000000U
// .. .. ..
MaskWrite(0xF8000108, 0x00000010, 0x00000000),
// .. .. .. FINISH: REMOVE PLL BY PASS
// .. .. FINISH: IO PLL INIT
// .. FINISH: PLL SLCR REGISTERS
// .. START: LOCK IT BACK
// .. LOCK_KEY = 0x767B
// .. ==> 0xF8000004[15:0] = 0x0000767BU
// .. ==> MASK : 0x0000FFFFU VAL : 0x0000767BU
// ..
MaskWrite(0xF8000004, 0x0000FFFF, 0x0000767B),
// .. FINISH: LOCK IT BACK
// FINISH: top
// *** ps7_clock_init_data_3_0 ***
// START: top
// .. START: SLCR SETTINGS
// .. UNLOCK_KEY = 0xDF0D
// .. ==> 0xF8000008[15:0] = 0x0000DF0DU
// .. ==> MASK : 0x0000FFFFU VAL : 0x0000DF0DU
// ..
MaskWrite(0xF8000008, 0x0000FFFF, 0x0000DF0D),
// .. FINISH: SLCR SETTINGS
// .. START: CLOCK CONTROL SLCR REGISTERS
// .. CLKACT = 0x1
// .. ==> 0xF8000128[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. DIVISOR0 = 0x23
// .. ==> 0xF8000128[13:8] = 0x00000023U
// .. ==> MASK : 0x00003F00U VAL : 0x00002300U
// .. DIVISOR1 = 0x3
// .. ==> 0xF8000128[25:20] = 0x00000003U
// .. ==> MASK : 0x03F00000U VAL : 0x00300000U
// ..
MaskWrite(0xF8000128, 0x03F03F01, 0x00302301),
// .. CLKACT = 0x1
// .. ==> 0xF8000138[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. SRCSEL = 0x0
// .. ==> 0xF8000138[4:4] = 0x00000000U
// .. ==> MASK : 0x00000010U VAL : 0x00000000U
// ..
MaskWrite(0xF8000138, 0x00000011, 0x00000001),
// .. CLKACT = 0x1
// .. ==> 0xF8000140[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. SRCSEL = 0x0
// .. ==> 0xF8000140[6:4] = 0x00000000U
// .. ==> MASK : 0x00000070U VAL : 0x00000000U
// .. DIVISOR = 0x8
// .. ==> 0xF8000140[13:8] = 0x00000008U
// .. ==> MASK : 0x00003F00U VAL : 0x00000800U
// .. DIVISOR1 = 0x5
// .. ==> 0xF8000140[25:20] = 0x00000005U
// .. ==> MASK : 0x03F00000U VAL : 0x00500000U
// ..
MaskWrite(0xF8000140, 0x03F03F71, 0x00500801),
// .. CLKACT = 0x1
// .. ==> 0xF800014C[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. SRCSEL = 0x0
// .. ==> 0xF800014C[5:4] = 0x00000000U
// .. ==> MASK : 0x00000030U VAL : 0x00000000U
// .. DIVISOR = 0x5
// .. ==> 0xF800014C[13:8] = 0x00000005U
// .. ==> MASK : 0x00003F00U VAL : 0x00000500U
// ..
MaskWrite(0xF800014C, 0x00003F31, 0x00000501),
// .. CLKACT0 = 0x1
// .. ==> 0xF8000150[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. CLKACT1 = 0x0
// .. ==> 0xF8000150[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. SRCSEL = 0x0
// .. ==> 0xF8000150[5:4] = 0x00000000U
// .. ==> MASK : 0x00000030U VAL : 0x00000000U
// .. DIVISOR = 0x14
// .. ==> 0xF8000150[13:8] = 0x00000014U
// .. ==> MASK : 0x00003F00U VAL : 0x00001400U
// ..
MaskWrite(0xF8000150, 0x00003F33, 0x00001401),
// .. CLKACT0 = 0x0
// .. ==> 0xF8000154[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. CLKACT1 = 0x1
// .. ==> 0xF8000154[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. SRCSEL = 0x0
// .. ==> 0xF8000154[5:4] = 0x00000000U
// .. ==> MASK : 0x00000030U VAL : 0x00000000U
// .. DIVISOR = 0x14
// .. ==> 0xF8000154[13:8] = 0x00000014U
// .. ==> MASK : 0x00003F00U VAL : 0x00001400U
// ..
MaskWrite(0xF8000154, 0x00003F33, 0x00001402),
// .. CLKACT0 = 0x1
// .. ==> 0xF800015C[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. CLKACT1 = 0x0
// .. ==> 0xF800015C[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. SRCSEL = 0x0
// .. ==> 0xF800015C[5:4] = 0x00000000U
// .. ==> MASK : 0x00000030U VAL : 0x00000000U
// .. DIVISOR0 = 0xe
// .. ==> 0xF800015C[13:8] = 0x0000000EU
// .. ==> MASK : 0x00003F00U VAL : 0x00000E00U
// .. DIVISOR1 = 0x3
// .. ==> 0xF800015C[25:20] = 0x00000003U
// .. ==> MASK : 0x03F00000U VAL : 0x00300000U
// ..
MaskWrite(0xF800015C, 0x03F03F33, 0x00300E01),
// .. CAN0_MUX = 0x0
// .. ==> 0xF8000160[5:0] = 0x00000000U
// .. ==> MASK : 0x0000003FU VAL : 0x00000000U
// .. CAN0_REF_SEL = 0x0
// .. ==> 0xF8000160[6:6] = 0x00000000U
// .. ==> MASK : 0x00000040U VAL : 0x00000000U
// .. CAN1_MUX = 0x0
// .. ==> 0xF8000160[21:16] = 0x00000000U
// .. ==> MASK : 0x003F0000U VAL : 0x00000000U
// .. CAN1_REF_SEL = 0x0
// .. ==> 0xF8000160[22:22] = 0x00000000U
// .. ==> MASK : 0x00400000U VAL : 0x00000000U
// ..
MaskWrite(0xF8000160, 0x007F007F, 0x00000000),
// .. CLKACT = 0x1
// .. ==> 0xF8000168[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. SRCSEL = 0x0
// .. ==> 0xF8000168[5:4] = 0x00000000U
// .. ==> MASK : 0x00000030U VAL : 0x00000000U
// .. DIVISOR = 0x5
// .. ==> 0xF8000168[13:8] = 0x00000005U
// .. ==> MASK : 0x00003F00U VAL : 0x00000500U
// ..
MaskWrite(0xF8000168, 0x00003F31, 0x00000501),
// .. SRCSEL = 0x0
// .. ==> 0xF8000170[5:4] = 0x00000000U
// .. ==> MASK : 0x00000030U VAL : 0x00000000U
// .. DIVISOR0 = 0x14
// .. ==> 0xF8000170[13:8] = 0x00000014U
// .. ==> MASK : 0x00003F00U VAL : 0x00001400U
// .. DIVISOR1 = 0x1
// .. ==> 0xF8000170[25:20] = 0x00000001U
// .. ==> MASK : 0x03F00000U VAL : 0x00100000U
// ..
MaskWrite(0xF8000170, 0x03F03F30, 0x00101400),
// .. SRCSEL = 0x0
// .. ==> 0xF8000180[5:4] = 0x00000000U
// .. ==> MASK : 0x00000030U VAL : 0x00000000U
// .. DIVISOR0 = 0x14
// .. ==> 0xF8000180[13:8] = 0x00000014U
// .. ==> MASK : 0x00003F00U VAL : 0x00001400U
// .. DIVISOR1 = 0x1
// .. ==> 0xF8000180[25:20] = 0x00000001U
// .. ==> MASK : 0x03F00000U VAL : 0x00100000U
// ..
MaskWrite(0xF8000180, 0x03F03F30, 0x00101400),
// .. SRCSEL = 0x0
// .. ==> 0xF8000190[5:4] = 0x00000000U
// .. ==> MASK : 0x00000030U VAL : 0x00000000U
// .. DIVISOR0 = 0x14
// .. ==> 0xF8000190[13:8] = 0x00000014U
// .. ==> MASK : 0x00003F00U VAL : 0x00001400U
// .. DIVISOR1 = 0x1
// .. ==> 0xF8000190[25:20] = 0x00000001U
// .. ==> MASK : 0x03F00000U VAL : 0x00100000U
// ..
MaskWrite(0xF8000190, 0x03F03F30, 0x00101400),
// .. SRCSEL = 0x0
// .. ==> 0xF80001A0[5:4] = 0x00000000U
// .. ==> MASK : 0x00000030U VAL : 0x00000000U
// .. DIVISOR0 = 0x14
// .. ==> 0xF80001A0[13:8] = 0x00000014U
// .. ==> MASK : 0x00003F00U VAL : 0x00001400U
// .. DIVISOR1 = 0x1
// .. ==> 0xF80001A0[25:20] = 0x00000001U
// .. ==> MASK : 0x03F00000U VAL : 0x00100000U
// ..
MaskWrite(0xF80001A0, 0x03F03F30, 0x00101400),
// .. CLK_621_TRUE = 0x1
// .. ==> 0xF80001C4[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// ..
MaskWrite(0xF80001C4, 0x00000001, 0x00000001),
// .. DMA_CPU_2XCLKACT = 0x1
// .. ==> 0xF800012C[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. USB0_CPU_1XCLKACT = 0x1
// .. ==> 0xF800012C[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. USB1_CPU_1XCLKACT = 0x1
// .. ==> 0xF800012C[3:3] = 0x00000001U
// .. ==> MASK : 0x00000008U VAL : 0x00000008U
// .. GEM0_CPU_1XCLKACT = 0x1
// .. ==> 0xF800012C[6:6] = 0x00000001U
// .. ==> MASK : 0x00000040U VAL : 0x00000040U
// .. GEM1_CPU_1XCLKACT = 0x0
// .. ==> 0xF800012C[7:7] = 0x00000000U
// .. ==> MASK : 0x00000080U VAL : 0x00000000U
// .. SDI0_CPU_1XCLKACT = 0x1
// .. ==> 0xF800012C[10:10] = 0x00000001U
// .. ==> MASK : 0x00000400U VAL : 0x00000400U
// .. SDI1_CPU_1XCLKACT = 0x0
// .. ==> 0xF800012C[11:11] = 0x00000000U
// .. ==> MASK : 0x00000800U VAL : 0x00000000U
// .. SPI0_CPU_1XCLKACT = 0x0
// .. ==> 0xF800012C[14:14] = 0x00000000U
// .. ==> MASK : 0x00004000U VAL : 0x00000000U
// .. SPI1_CPU_1XCLKACT = 0x0
// .. ==> 0xF800012C[15:15] = 0x00000000U
// .. ==> MASK : 0x00008000U VAL : 0x00000000U
// .. CAN0_CPU_1XCLKACT = 0x1
// .. ==> 0xF800012C[16:16] = 0x00000001U
// .. ==> MASK : 0x00010000U VAL : 0x00010000U
// .. CAN1_CPU_1XCLKACT = 0x0
// .. ==> 0xF800012C[17:17] = 0x00000000U
// .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. I2C0_CPU_1XCLKACT = 0x1
// .. ==> 0xF800012C[18:18] = 0x00000001U
// .. ==> MASK : 0x00040000U VAL : 0x00040000U
// .. I2C1_CPU_1XCLKACT = 0x1
// .. ==> 0xF800012C[19:19] = 0x00000001U
// .. ==> MASK : 0x00080000U VAL : 0x00080000U
// .. UART0_CPU_1XCLKACT = 0x0
// .. ==> 0xF800012C[20:20] = 0x00000000U
// .. ==> MASK : 0x00100000U VAL : 0x00000000U
// .. UART1_CPU_1XCLKACT = 0x1
// .. ==> 0xF800012C[21:21] = 0x00000001U
// .. ==> MASK : 0x00200000U VAL : 0x00200000U
// .. GPIO_CPU_1XCLKACT = 0x1
// .. ==> 0xF800012C[22:22] = 0x00000001U
// .. ==> MASK : 0x00400000U VAL : 0x00400000U
// .. LQSPI_CPU_1XCLKACT = 0x1
// .. ==> 0xF800012C[23:23] = 0x00000001U
// .. ==> MASK : 0x00800000U VAL : 0x00800000U
// .. SMC_CPU_1XCLKACT = 0x1
// .. ==> 0xF800012C[24:24] = 0x00000001U
// .. ==> MASK : 0x01000000U VAL : 0x01000000U
// ..
MaskWrite(0xF800012C, 0x01FFCCCD, 0x01ED044D),
// .. FINISH: CLOCK CONTROL SLCR REGISTERS
// .. START: THIS SHOULD BE BLANK
// .. FINISH: THIS SHOULD BE BLANK
// .. START: LOCK IT BACK
// .. LOCK_KEY = 0x767B
// .. ==> 0xF8000004[15:0] = 0x0000767BU
// .. ==> MASK : 0x0000FFFFU VAL : 0x0000767BU
// ..
MaskWrite(0xF8000004, 0x0000FFFF, 0x0000767B),
// .. FINISH: LOCK IT BACK
// FINISH: top
// *** ps7_ddr_init_data_3_0 ***
// START: top
// .. START: DDR INITIALIZATION
// .. .. START: LOCK DDR
// .. .. reg_ddrc_soft_rstb = 0
// .. .. ==> 0xF8006000[0:0] = 0x00000000U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. reg_ddrc_powerdown_en = 0x0
// .. .. ==> 0xF8006000[1:1] = 0x00000000U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. .. reg_ddrc_data_bus_width = 0x0
// .. .. ==> 0xF8006000[3:2] = 0x00000000U
// .. .. ==> MASK : 0x0000000CU VAL : 0x00000000U
// .. .. reg_ddrc_burst8_refresh = 0x0
// .. .. ==> 0xF8006000[6:4] = 0x00000000U
// .. .. ==> MASK : 0x00000070U VAL : 0x00000000U
// .. .. reg_ddrc_rdwr_idle_gap = 0x1
// .. .. ==> 0xF8006000[13:7] = 0x00000001U
// .. .. ==> MASK : 0x00003F80U VAL : 0x00000080U
// .. .. reg_ddrc_dis_rd_bypass = 0x0
// .. .. ==> 0xF8006000[14:14] = 0x00000000U
// .. .. ==> MASK : 0x00004000U VAL : 0x00000000U
// .. .. reg_ddrc_dis_act_bypass = 0x0
// .. .. ==> 0xF8006000[15:15] = 0x00000000U
// .. .. ==> MASK : 0x00008000U VAL : 0x00000000U
// .. .. reg_ddrc_dis_auto_refresh = 0x0
// .. .. ==> 0xF8006000[16:16] = 0x00000000U
// .. .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006000, 0x0001FFFF, 0x00000080),
// .. .. FINISH: LOCK DDR
// .. .. reg_ddrc_t_rfc_nom_x32 = 0x81
// .. .. ==> 0xF8006004[11:0] = 0x00000081U
// .. .. ==> MASK : 0x00000FFFU VAL : 0x00000081U
// .. .. reserved_reg_ddrc_active_ranks = 0x1
// .. .. ==> 0xF8006004[13:12] = 0x00000001U
// .. .. ==> MASK : 0x00003000U VAL : 0x00001000U
// .. .. reg_ddrc_addrmap_cs_bit0 = 0x0
// .. .. ==> 0xF8006004[18:14] = 0x00000000U
// .. .. ==> MASK : 0x0007C000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006004, 0x0007FFFF, 0x00001081),
// .. .. reg_ddrc_hpr_min_non_critical_x32 = 0xf
// .. .. ==> 0xF8006008[10:0] = 0x0000000FU
// .. .. ==> MASK : 0x000007FFU VAL : 0x0000000FU
// .. .. reg_ddrc_hpr_max_starve_x32 = 0xf
// .. .. ==> 0xF8006008[21:11] = 0x0000000FU
// .. .. ==> MASK : 0x003FF800U VAL : 0x00007800U
// .. .. reg_ddrc_hpr_xact_run_length = 0xf
// .. .. ==> 0xF8006008[25:22] = 0x0000000FU
// .. .. ==> MASK : 0x03C00000U VAL : 0x03C00000U
// .. ..
MaskWrite(0xF8006008, 0x03FFFFFF, 0x03C0780F),
// .. .. reg_ddrc_lpr_min_non_critical_x32 = 0x1
// .. .. ==> 0xF800600C[10:0] = 0x00000001U
// .. .. ==> MASK : 0x000007FFU VAL : 0x00000001U
// .. .. reg_ddrc_lpr_max_starve_x32 = 0x2
// .. .. ==> 0xF800600C[21:11] = 0x00000002U
// .. .. ==> MASK : 0x003FF800U VAL : 0x00001000U
// .. .. reg_ddrc_lpr_xact_run_length = 0x8
// .. .. ==> 0xF800600C[25:22] = 0x00000008U
// .. .. ==> MASK : 0x03C00000U VAL : 0x02000000U
// .. ..
MaskWrite(0xF800600C, 0x03FFFFFF, 0x02001001),
// .. .. reg_ddrc_w_min_non_critical_x32 = 0x1
// .. .. ==> 0xF8006010[10:0] = 0x00000001U
// .. .. ==> MASK : 0x000007FFU VAL : 0x00000001U
// .. .. reg_ddrc_w_xact_run_length = 0x8
// .. .. ==> 0xF8006010[14:11] = 0x00000008U
// .. .. ==> MASK : 0x00007800U VAL : 0x00004000U
// .. .. reg_ddrc_w_max_starve_x32 = 0x2
// .. .. ==> 0xF8006010[25:15] = 0x00000002U
// .. .. ==> MASK : 0x03FF8000U VAL : 0x00010000U
// .. ..
MaskWrite(0xF8006010, 0x03FFFFFF, 0x00014001),
// .. .. reg_ddrc_t_rc = 0x1b
// .. .. ==> 0xF8006014[5:0] = 0x0000001BU
// .. .. ==> MASK : 0x0000003FU VAL : 0x0000001BU
// .. .. reg_ddrc_t_rfc_min = 0x56
// .. .. ==> 0xF8006014[13:6] = 0x00000056U
// .. .. ==> MASK : 0x00003FC0U VAL : 0x00001580U
// .. .. reg_ddrc_post_selfref_gap_x32 = 0x10
// .. .. ==> 0xF8006014[20:14] = 0x00000010U
// .. .. ==> MASK : 0x001FC000U VAL : 0x00040000U
// .. ..
MaskWrite(0xF8006014, 0x001FFFFF, 0x0004159B),
// .. .. reg_ddrc_wr2pre = 0x12
// .. .. ==> 0xF8006018[4:0] = 0x00000012U
// .. .. ==> MASK : 0x0000001FU VAL : 0x00000012U
// .. .. reg_ddrc_powerdown_to_x32 = 0x6
// .. .. ==> 0xF8006018[9:5] = 0x00000006U
// .. .. ==> MASK : 0x000003E0U VAL : 0x000000C0U
// .. .. reg_ddrc_t_faw = 0x10
// .. .. ==> 0xF8006018[15:10] = 0x00000010U
// .. .. ==> MASK : 0x0000FC00U VAL : 0x00004000U
// .. .. reg_ddrc_t_ras_max = 0x24
// .. .. ==> 0xF8006018[21:16] = 0x00000024U
// .. .. ==> MASK : 0x003F0000U VAL : 0x00240000U
// .. .. reg_ddrc_t_ras_min = 0x14
// .. .. ==> 0xF8006018[26:22] = 0x00000014U
// .. .. ==> MASK : 0x07C00000U VAL : 0x05000000U
// .. .. reg_ddrc_t_cke = 0x4
// .. .. ==> 0xF8006018[31:28] = 0x00000004U
// .. .. ==> MASK : 0xF0000000U VAL : 0x40000000U
// .. ..
MaskWrite(0xF8006018, 0xF7FFFFFF, 0x452440D2),
// .. .. reg_ddrc_write_latency = 0x5
// .. .. ==> 0xF800601C[4:0] = 0x00000005U
// .. .. ==> MASK : 0x0000001FU VAL : 0x00000005U
// .. .. reg_ddrc_rd2wr = 0x7
// .. .. ==> 0xF800601C[9:5] = 0x00000007U
// .. .. ==> MASK : 0x000003E0U VAL : 0x000000E0U
// .. .. reg_ddrc_wr2rd = 0xe
// .. .. ==> 0xF800601C[14:10] = 0x0000000EU
// .. .. ==> MASK : 0x00007C00U VAL : 0x00003800U
// .. .. reg_ddrc_t_xp = 0x4
// .. .. ==> 0xF800601C[19:15] = 0x00000004U
// .. .. ==> MASK : 0x000F8000U VAL : 0x00020000U
// .. .. reg_ddrc_pad_pd = 0x0
// .. .. ==> 0xF800601C[22:20] = 0x00000000U
// .. .. ==> MASK : 0x00700000U VAL : 0x00000000U
// .. .. reg_ddrc_rd2pre = 0x4
// .. .. ==> 0xF800601C[27:23] = 0x00000004U
// .. .. ==> MASK : 0x0F800000U VAL : 0x02000000U
// .. .. reg_ddrc_t_rcd = 0x7
// .. .. ==> 0xF800601C[31:28] = 0x00000007U
// .. .. ==> MASK : 0xF0000000U VAL : 0x70000000U
// .. ..
MaskWrite(0xF800601C, 0xFFFFFFFF, 0x720238E5),
// .. .. reg_ddrc_t_ccd = 0x4
// .. .. ==> 0xF8006020[4:2] = 0x00000004U
// .. .. ==> MASK : 0x0000001CU VAL : 0x00000010U
// .. .. reg_ddrc_t_rrd = 0x4
// .. .. ==> 0xF8006020[7:5] = 0x00000004U
// .. .. ==> MASK : 0x000000E0U VAL : 0x00000080U
// .. .. reg_ddrc_refresh_margin = 0x2
// .. .. ==> 0xF8006020[11:8] = 0x00000002U
// .. .. ==> MASK : 0x00000F00U VAL : 0x00000200U
// .. .. reg_ddrc_t_rp = 0x7
// .. .. ==> 0xF8006020[15:12] = 0x00000007U
// .. .. ==> MASK : 0x0000F000U VAL : 0x00007000U
// .. .. reg_ddrc_refresh_to_x32 = 0x8
// .. .. ==> 0xF8006020[20:16] = 0x00000008U
// .. .. ==> MASK : 0x001F0000U VAL : 0x00080000U
// .. .. reg_ddrc_mobile = 0x0
// .. .. ==> 0xF8006020[22:22] = 0x00000000U
// .. .. ==> MASK : 0x00400000U VAL : 0x00000000U
// .. .. reg_ddrc_en_dfi_dram_clk_disable = 0x0
// .. .. ==> 0xF8006020[23:23] = 0x00000000U
// .. .. ==> MASK : 0x00800000U VAL : 0x00000000U
// .. .. reg_ddrc_read_latency = 0x7
// .. .. ==> 0xF8006020[28:24] = 0x00000007U
// .. .. ==> MASK : 0x1F000000U VAL : 0x07000000U
// .. .. reg_phy_mode_ddr1_ddr2 = 0x1
// .. .. ==> 0xF8006020[29:29] = 0x00000001U
// .. .. ==> MASK : 0x20000000U VAL : 0x20000000U
// .. .. reg_ddrc_dis_pad_pd = 0x0
// .. .. ==> 0xF8006020[30:30] = 0x00000000U
// .. .. ==> MASK : 0x40000000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006020, 0x7FDFFFFC, 0x27087290),
// .. .. reg_ddrc_en_2t_timing_mode = 0x0
// .. .. ==> 0xF8006024[0:0] = 0x00000000U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. reg_ddrc_prefer_write = 0x0
// .. .. ==> 0xF8006024[1:1] = 0x00000000U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. .. reg_ddrc_mr_wr = 0x0
// .. .. ==> 0xF8006024[6:6] = 0x00000000U
// .. .. ==> MASK : 0x00000040U VAL : 0x00000000U
// .. .. reg_ddrc_mr_addr = 0x0
// .. .. ==> 0xF8006024[8:7] = 0x00000000U
// .. .. ==> MASK : 0x00000180U VAL : 0x00000000U
// .. .. reg_ddrc_mr_data = 0x0
// .. .. ==> 0xF8006024[24:9] = 0x00000000U
// .. .. ==> MASK : 0x01FFFE00U VAL : 0x00000000U
// .. .. ddrc_reg_mr_wr_busy = 0x0
// .. .. ==> 0xF8006024[25:25] = 0x00000000U
// .. .. ==> MASK : 0x02000000U VAL : 0x00000000U
// .. .. reg_ddrc_mr_type = 0x0
// .. .. ==> 0xF8006024[26:26] = 0x00000000U
// .. .. ==> MASK : 0x04000000U VAL : 0x00000000U
// .. .. reg_ddrc_mr_rdata_valid = 0x0
// .. .. ==> 0xF8006024[27:27] = 0x00000000U
// .. .. ==> MASK : 0x08000000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006024, 0x0FFFFFC3, 0x00000000),
// .. .. reg_ddrc_final_wait_x32 = 0x7
// .. .. ==> 0xF8006028[6:0] = 0x00000007U
// .. .. ==> MASK : 0x0000007FU VAL : 0x00000007U
// .. .. reg_ddrc_pre_ocd_x32 = 0x0
// .. .. ==> 0xF8006028[10:7] = 0x00000000U
// .. .. ==> MASK : 0x00000780U VAL : 0x00000000U
// .. .. reg_ddrc_t_mrd = 0x4
// .. .. ==> 0xF8006028[13:11] = 0x00000004U
// .. .. ==> MASK : 0x00003800U VAL : 0x00002000U
// .. ..
MaskWrite(0xF8006028, 0x00003FFF, 0x00002007),
// .. .. reg_ddrc_emr2 = 0x8
// .. .. ==> 0xF800602C[15:0] = 0x00000008U
// .. .. ==> MASK : 0x0000FFFFU VAL : 0x00000008U
// .. .. reg_ddrc_emr3 = 0x0
// .. .. ==> 0xF800602C[31:16] = 0x00000000U
// .. .. ==> MASK : 0xFFFF0000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF800602C, 0xFFFFFFFF, 0x00000008),
// .. .. reg_ddrc_mr = 0x930
// .. .. ==> 0xF8006030[15:0] = 0x00000930U
// .. .. ==> MASK : 0x0000FFFFU VAL : 0x00000930U
// .. .. reg_ddrc_emr = 0x4
// .. .. ==> 0xF8006030[31:16] = 0x00000004U
// .. .. ==> MASK : 0xFFFF0000U VAL : 0x00040000U
// .. ..
MaskWrite(0xF8006030, 0xFFFFFFFF, 0x00040930),
// .. .. reg_ddrc_burst_rdwr = 0x4
// .. .. ==> 0xF8006034[3:0] = 0x00000004U
// .. .. ==> MASK : 0x0000000FU VAL : 0x00000004U
// .. .. reg_ddrc_pre_cke_x1024 = 0x105
// .. .. ==> 0xF8006034[13:4] = 0x00000105U
// .. .. ==> MASK : 0x00003FF0U VAL : 0x00001050U
// .. .. reg_ddrc_post_cke_x1024 = 0x1
// .. .. ==> 0xF8006034[25:16] = 0x00000001U
// .. .. ==> MASK : 0x03FF0000U VAL : 0x00010000U
// .. .. reg_ddrc_burstchop = 0x0
// .. .. ==> 0xF8006034[28:28] = 0x00000000U
// .. .. ==> MASK : 0x10000000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006034, 0x13FF3FFF, 0x00011054),
// .. .. reg_ddrc_force_low_pri_n = 0x0
// .. .. ==> 0xF8006038[0:0] = 0x00000000U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. reg_ddrc_dis_dq = 0x0
// .. .. ==> 0xF8006038[1:1] = 0x00000000U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006038, 0x00000003, 0x00000000),
// .. .. reg_ddrc_addrmap_bank_b0 = 0x7
// .. .. ==> 0xF800603C[3:0] = 0x00000007U
// .. .. ==> MASK : 0x0000000FU VAL : 0x00000007U
// .. .. reg_ddrc_addrmap_bank_b1 = 0x7
// .. .. ==> 0xF800603C[7:4] = 0x00000007U
// .. .. ==> MASK : 0x000000F0U VAL : 0x00000070U
// .. .. reg_ddrc_addrmap_bank_b2 = 0x7
// .. .. ==> 0xF800603C[11:8] = 0x00000007U
// .. .. ==> MASK : 0x00000F00U VAL : 0x00000700U
// .. .. reg_ddrc_addrmap_col_b5 = 0x0
// .. .. ==> 0xF800603C[15:12] = 0x00000000U
// .. .. ==> MASK : 0x0000F000U VAL : 0x00000000U
// .. .. reg_ddrc_addrmap_col_b6 = 0x0
// .. .. ==> 0xF800603C[19:16] = 0x00000000U
// .. .. ==> MASK : 0x000F0000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF800603C, 0x000FFFFF, 0x00000777),
// .. .. reg_ddrc_addrmap_col_b2 = 0x0
// .. .. ==> 0xF8006040[3:0] = 0x00000000U
// .. .. ==> MASK : 0x0000000FU VAL : 0x00000000U
// .. .. reg_ddrc_addrmap_col_b3 = 0x0
// .. .. ==> 0xF8006040[7:4] = 0x00000000U
// .. .. ==> MASK : 0x000000F0U VAL : 0x00000000U
// .. .. reg_ddrc_addrmap_col_b4 = 0x0
// .. .. ==> 0xF8006040[11:8] = 0x00000000U
// .. .. ==> MASK : 0x00000F00U VAL : 0x00000000U
// .. .. reg_ddrc_addrmap_col_b7 = 0x0
// .. .. ==> 0xF8006040[15:12] = 0x00000000U
// .. .. ==> MASK : 0x0000F000U VAL : 0x00000000U
// .. .. reg_ddrc_addrmap_col_b8 = 0x0
// .. .. ==> 0xF8006040[19:16] = 0x00000000U
// .. .. ==> MASK : 0x000F0000U VAL : 0x00000000U
// .. .. reg_ddrc_addrmap_col_b9 = 0xf
// .. .. ==> 0xF8006040[23:20] = 0x0000000FU
// .. .. ==> MASK : 0x00F00000U VAL : 0x00F00000U
// .. .. reg_ddrc_addrmap_col_b10 = 0xf
// .. .. ==> 0xF8006040[27:24] = 0x0000000FU
// .. .. ==> MASK : 0x0F000000U VAL : 0x0F000000U
// .. .. reg_ddrc_addrmap_col_b11 = 0xf
// .. .. ==> 0xF8006040[31:28] = 0x0000000FU
// .. .. ==> MASK : 0xF0000000U VAL : 0xF0000000U
// .. ..
MaskWrite(0xF8006040, 0xFFFFFFFF, 0xFFF00000),
// .. .. reg_ddrc_addrmap_row_b0 = 0x6
// .. .. ==> 0xF8006044[3:0] = 0x00000006U
// .. .. ==> MASK : 0x0000000FU VAL : 0x00000006U
// .. .. reg_ddrc_addrmap_row_b1 = 0x6
// .. .. ==> 0xF8006044[7:4] = 0x00000006U
// .. .. ==> MASK : 0x000000F0U VAL : 0x00000060U
// .. .. reg_ddrc_addrmap_row_b2_11 = 0x6
// .. .. ==> 0xF8006044[11:8] = 0x00000006U
// .. .. ==> MASK : 0x00000F00U VAL : 0x00000600U
// .. .. reg_ddrc_addrmap_row_b12 = 0x6
// .. .. ==> 0xF8006044[15:12] = 0x00000006U
// .. .. ==> MASK : 0x0000F000U VAL : 0x00006000U
// .. .. reg_ddrc_addrmap_row_b13 = 0x6
// .. .. ==> 0xF8006044[19:16] = 0x00000006U
// .. .. ==> MASK : 0x000F0000U VAL : 0x00060000U
// .. .. reg_ddrc_addrmap_row_b14 = 0x6
// .. .. ==> 0xF8006044[23:20] = 0x00000006U
// .. .. ==> MASK : 0x00F00000U VAL : 0x00600000U
// .. .. reg_ddrc_addrmap_row_b15 = 0xf
// .. .. ==> 0xF8006044[27:24] = 0x0000000FU
// .. .. ==> MASK : 0x0F000000U VAL : 0x0F000000U
// .. ..
MaskWrite(0xF8006044, 0x0FFFFFFF, 0x0F666666),
// .. .. reg_phy_rd_local_odt = 0x0
// .. .. ==> 0xF8006048[13:12] = 0x00000000U
// .. .. ==> MASK : 0x00003000U VAL : 0x00000000U
// .. .. reg_phy_wr_local_odt = 0x3
// .. .. ==> 0xF8006048[15:14] = 0x00000003U
// .. .. ==> MASK : 0x0000C000U VAL : 0x0000C000U
// .. .. reg_phy_idle_local_odt = 0x3
// .. .. ==> 0xF8006048[17:16] = 0x00000003U
// .. .. ==> MASK : 0x00030000U VAL : 0x00030000U
// .. ..
MaskWrite(0xF8006048, 0x0003F000, 0x0003C000),
// .. .. reg_phy_rd_cmd_to_data = 0x0
// .. .. ==> 0xF8006050[3:0] = 0x00000000U
// .. .. ==> MASK : 0x0000000FU VAL : 0x00000000U
// .. .. reg_phy_wr_cmd_to_data = 0x0
// .. .. ==> 0xF8006050[7:4] = 0x00000000U
// .. .. ==> MASK : 0x000000F0U VAL : 0x00000000U
// .. .. reg_phy_rdc_we_to_re_delay = 0x8
// .. .. ==> 0xF8006050[11:8] = 0x00000008U
// .. .. ==> MASK : 0x00000F00U VAL : 0x00000800U
// .. .. reg_phy_rdc_fifo_rst_disable = 0x0
// .. .. ==> 0xF8006050[15:15] = 0x00000000U
// .. .. ==> MASK : 0x00008000U VAL : 0x00000000U
// .. .. reg_phy_use_fixed_re = 0x1
// .. .. ==> 0xF8006050[16:16] = 0x00000001U
// .. .. ==> MASK : 0x00010000U VAL : 0x00010000U
// .. .. reg_phy_rdc_fifo_rst_err_cnt_clr = 0x0
// .. .. ==> 0xF8006050[17:17] = 0x00000000U
// .. .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. .. reg_phy_dis_phy_ctrl_rstn = 0x0
// .. .. ==> 0xF8006050[18:18] = 0x00000000U
// .. .. ==> MASK : 0x00040000U VAL : 0x00000000U
// .. .. reg_phy_clk_stall_level = 0x0
// .. .. ==> 0xF8006050[19:19] = 0x00000000U
// .. .. ==> MASK : 0x00080000U VAL : 0x00000000U
// .. .. reg_phy_gatelvl_num_of_dq0 = 0x7
// .. .. ==> 0xF8006050[27:24] = 0x00000007U
// .. .. ==> MASK : 0x0F000000U VAL : 0x07000000U
// .. .. reg_phy_wrlvl_num_of_dq0 = 0x7
// .. .. ==> 0xF8006050[31:28] = 0x00000007U
// .. .. ==> MASK : 0xF0000000U VAL : 0x70000000U
// .. ..
MaskWrite(0xF8006050, 0xFF0F8FFF, 0x77010800),
// .. .. reg_ddrc_dis_dll_calib = 0x0
// .. .. ==> 0xF8006058[16:16] = 0x00000000U
// .. .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006058, 0x00010000, 0x00000000),
// .. .. reg_ddrc_rd_odt_delay = 0x3
// .. .. ==> 0xF800605C[3:0] = 0x00000003U
// .. .. ==> MASK : 0x0000000FU VAL : 0x00000003U
// .. .. reg_ddrc_wr_odt_delay = 0x0
// .. .. ==> 0xF800605C[7:4] = 0x00000000U
// .. .. ==> MASK : 0x000000F0U VAL : 0x00000000U
// .. .. reg_ddrc_rd_odt_hold = 0x0
// .. .. ==> 0xF800605C[11:8] = 0x00000000U
// .. .. ==> MASK : 0x00000F00U VAL : 0x00000000U
// .. .. reg_ddrc_wr_odt_hold = 0x5
// .. .. ==> 0xF800605C[15:12] = 0x00000005U
// .. .. ==> MASK : 0x0000F000U VAL : 0x00005000U
// .. ..
MaskWrite(0xF800605C, 0x0000FFFF, 0x00005003),
// .. .. reg_ddrc_pageclose = 0x0
// .. .. ==> 0xF8006060[0:0] = 0x00000000U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. reg_ddrc_lpr_num_entries = 0x1f
// .. .. ==> 0xF8006060[6:1] = 0x0000001FU
// .. .. ==> MASK : 0x0000007EU VAL : 0x0000003EU
// .. .. reg_ddrc_auto_pre_en = 0x0
// .. .. ==> 0xF8006060[7:7] = 0x00000000U
// .. .. ==> MASK : 0x00000080U VAL : 0x00000000U
// .. .. reg_ddrc_refresh_update_level = 0x0
// .. .. ==> 0xF8006060[8:8] = 0x00000000U
// .. .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. .. reg_ddrc_dis_wc = 0x0
// .. .. ==> 0xF8006060[9:9] = 0x00000000U
// .. .. ==> MASK : 0x00000200U VAL : 0x00000000U
// .. .. reg_ddrc_dis_collision_page_opt = 0x0
// .. .. ==> 0xF8006060[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_ddrc_selfref_en = 0x0
// .. .. ==> 0xF8006060[12:12] = 0x00000000U
// .. .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006060, 0x000017FF, 0x0000003E),
// .. .. reg_ddrc_go2critical_hysteresis = 0x0
// .. .. ==> 0xF8006064[12:5] = 0x00000000U
// .. .. ==> MASK : 0x00001FE0U VAL : 0x00000000U
// .. .. reg_arb_go2critical_en = 0x1
// .. .. ==> 0xF8006064[17:17] = 0x00000001U
// .. .. ==> MASK : 0x00020000U VAL : 0x00020000U
// .. ..
MaskWrite(0xF8006064, 0x00021FE0, 0x00020000),
// .. .. reg_ddrc_wrlvl_ww = 0x41
// .. .. ==> 0xF8006068[7:0] = 0x00000041U
// .. .. ==> MASK : 0x000000FFU VAL : 0x00000041U
// .. .. reg_ddrc_rdlvl_rr = 0x41
// .. .. ==> 0xF8006068[15:8] = 0x00000041U
// .. .. ==> MASK : 0x0000FF00U VAL : 0x00004100U
// .. .. reg_ddrc_dfi_t_wlmrd = 0x28
// .. .. ==> 0xF8006068[25:16] = 0x00000028U
// .. .. ==> MASK : 0x03FF0000U VAL : 0x00280000U
// .. ..
MaskWrite(0xF8006068, 0x03FFFFFF, 0x00284141),
// .. .. dfi_t_ctrlupd_interval_min_x1024 = 0x10
// .. .. ==> 0xF800606C[7:0] = 0x00000010U
// .. .. ==> MASK : 0x000000FFU VAL : 0x00000010U
// .. .. dfi_t_ctrlupd_interval_max_x1024 = 0x16
// .. .. ==> 0xF800606C[15:8] = 0x00000016U
// .. .. ==> MASK : 0x0000FF00U VAL : 0x00001600U
// .. ..
MaskWrite(0xF800606C, 0x0000FFFF, 0x00001610),
// .. .. reg_ddrc_dfi_t_ctrl_delay = 0x1
// .. .. ==> 0xF8006078[3:0] = 0x00000001U
// .. .. ==> MASK : 0x0000000FU VAL : 0x00000001U
// .. .. reg_ddrc_dfi_t_dram_clk_disable = 0x1
// .. .. ==> 0xF8006078[7:4] = 0x00000001U
// .. .. ==> MASK : 0x000000F0U VAL : 0x00000010U
// .. .. reg_ddrc_dfi_t_dram_clk_enable = 0x1
// .. .. ==> 0xF8006078[11:8] = 0x00000001U
// .. .. ==> MASK : 0x00000F00U VAL : 0x00000100U
// .. .. reg_ddrc_t_cksre = 0x6
// .. .. ==> 0xF8006078[15:12] = 0x00000006U
// .. .. ==> MASK : 0x0000F000U VAL : 0x00006000U
// .. .. reg_ddrc_t_cksrx = 0x6
// .. .. ==> 0xF8006078[19:16] = 0x00000006U
// .. .. ==> MASK : 0x000F0000U VAL : 0x00060000U
// .. .. reg_ddrc_t_ckesr = 0x4
// .. .. ==> 0xF8006078[25:20] = 0x00000004U
// .. .. ==> MASK : 0x03F00000U VAL : 0x00400000U
// .. ..
MaskWrite(0xF8006078, 0x03FFFFFF, 0x00466111),
// .. .. reg_ddrc_t_ckpde = 0x2
// .. .. ==> 0xF800607C[3:0] = 0x00000002U
// .. .. ==> MASK : 0x0000000FU VAL : 0x00000002U
// .. .. reg_ddrc_t_ckpdx = 0x2
// .. .. ==> 0xF800607C[7:4] = 0x00000002U
// .. .. ==> MASK : 0x000000F0U VAL : 0x00000020U
// .. .. reg_ddrc_t_ckdpde = 0x2
// .. .. ==> 0xF800607C[11:8] = 0x00000002U
// .. .. ==> MASK : 0x00000F00U VAL : 0x00000200U
// .. .. reg_ddrc_t_ckdpdx = 0x2
// .. .. ==> 0xF800607C[15:12] = 0x00000002U
// .. .. ==> MASK : 0x0000F000U VAL : 0x00002000U
// .. .. reg_ddrc_t_ckcsx = 0x3
// .. .. ==> 0xF800607C[19:16] = 0x00000003U
// .. .. ==> MASK : 0x000F0000U VAL : 0x00030000U
// .. ..
MaskWrite(0xF800607C, 0x000FFFFF, 0x00032222),
// .. .. reg_ddrc_dis_auto_zq = 0x0
// .. .. ==> 0xF80060A4[0:0] = 0x00000000U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. reg_ddrc_ddr3 = 0x1
// .. .. ==> 0xF80060A4[1:1] = 0x00000001U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. .. reg_ddrc_t_mod = 0x200
// .. .. ==> 0xF80060A4[11:2] = 0x00000200U
// .. .. ==> MASK : 0x00000FFCU VAL : 0x00000800U
// .. .. reg_ddrc_t_zq_long_nop = 0x200
// .. .. ==> 0xF80060A4[21:12] = 0x00000200U
// .. .. ==> MASK : 0x003FF000U VAL : 0x00200000U
// .. .. reg_ddrc_t_zq_short_nop = 0x40
// .. .. ==> 0xF80060A4[31:22] = 0x00000040U
// .. .. ==> MASK : 0xFFC00000U VAL : 0x10000000U
// .. ..
MaskWrite(0xF80060A4, 0xFFFFFFFF, 0x10200802),
// .. .. t_zq_short_interval_x1024 = 0xcb73
// .. .. ==> 0xF80060A8[19:0] = 0x0000CB73U
// .. .. ==> MASK : 0x000FFFFFU VAL : 0x0000CB73U
// .. .. dram_rstn_x1024 = 0x69
// .. .. ==> 0xF80060A8[27:20] = 0x00000069U
// .. .. ==> MASK : 0x0FF00000U VAL : 0x06900000U
// .. ..
MaskWrite(0xF80060A8, 0x0FFFFFFF, 0x0690CB73),
// .. .. deeppowerdown_en = 0x0
// .. .. ==> 0xF80060AC[0:0] = 0x00000000U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. deeppowerdown_to_x1024 = 0xff
// .. .. ==> 0xF80060AC[8:1] = 0x000000FFU
// .. .. ==> MASK : 0x000001FEU VAL : 0x000001FEU
// .. ..
MaskWrite(0xF80060AC, 0x000001FF, 0x000001FE),
// .. .. dfi_wrlvl_max_x1024 = 0xfff
// .. .. ==> 0xF80060B0[11:0] = 0x00000FFFU
// .. .. ==> MASK : 0x00000FFFU VAL : 0x00000FFFU
// .. .. dfi_rdlvl_max_x1024 = 0xfff
// .. .. ==> 0xF80060B0[23:12] = 0x00000FFFU
// .. .. ==> MASK : 0x00FFF000U VAL : 0x00FFF000U
// .. .. ddrc_reg_twrlvl_max_error = 0x0
// .. .. ==> 0xF80060B0[24:24] = 0x00000000U
// .. .. ==> MASK : 0x01000000U VAL : 0x00000000U
// .. .. ddrc_reg_trdlvl_max_error = 0x0
// .. .. ==> 0xF80060B0[25:25] = 0x00000000U
// .. .. ==> MASK : 0x02000000U VAL : 0x00000000U
// .. .. reg_ddrc_dfi_wr_level_en = 0x1
// .. .. ==> 0xF80060B0[26:26] = 0x00000001U
// .. .. ==> MASK : 0x04000000U VAL : 0x04000000U
// .. .. reg_ddrc_dfi_rd_dqs_gate_level = 0x1
// .. .. ==> 0xF80060B0[27:27] = 0x00000001U
// .. .. ==> MASK : 0x08000000U VAL : 0x08000000U
// .. .. reg_ddrc_dfi_rd_data_eye_train = 0x1
// .. .. ==> 0xF80060B0[28:28] = 0x00000001U
// .. .. ==> MASK : 0x10000000U VAL : 0x10000000U
// .. ..
MaskWrite(0xF80060B0, 0x1FFFFFFF, 0x1CFFFFFF),
// .. .. reg_ddrc_skip_ocd = 0x1
// .. .. ==> 0xF80060B4[9:9] = 0x00000001U
// .. .. ==> MASK : 0x00000200U VAL : 0x00000200U
// .. ..
MaskWrite(0xF80060B4, 0x00000200, 0x00000200),
// .. .. reg_ddrc_dfi_t_rddata_en = 0x6
// .. .. ==> 0xF80060B8[4:0] = 0x00000006U
// .. .. ==> MASK : 0x0000001FU VAL : 0x00000006U
// .. .. reg_ddrc_dfi_t_ctrlup_min = 0x3
// .. .. ==> 0xF80060B8[14:5] = 0x00000003U
// .. .. ==> MASK : 0x00007FE0U VAL : 0x00000060U
// .. .. reg_ddrc_dfi_t_ctrlup_max = 0x40
// .. .. ==> 0xF80060B8[24:15] = 0x00000040U
// .. .. ==> MASK : 0x01FF8000U VAL : 0x00200000U
// .. ..
MaskWrite(0xF80060B8, 0x01FFFFFF, 0x00200066),
// .. .. START: RESET ECC ERROR
// .. .. Clear_Uncorrectable_DRAM_ECC_error = 1
// .. .. ==> 0xF80060C4[0:0] = 0x00000001U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. Clear_Correctable_DRAM_ECC_error = 1
// .. .. ==> 0xF80060C4[1:1] = 0x00000001U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. ..
MaskWrite(0xF80060C4, 0x00000003, 0x00000003),
// .. .. FINISH: RESET ECC ERROR
// .. .. Clear_Uncorrectable_DRAM_ECC_error = 0x0
// .. .. ==> 0xF80060C4[0:0] = 0x00000000U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. Clear_Correctable_DRAM_ECC_error = 0x0
// .. .. ==> 0xF80060C4[1:1] = 0x00000000U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. ..
MaskWrite(0xF80060C4, 0x00000003, 0x00000000),
// .. .. CORR_ECC_LOG_VALID = 0x0
// .. .. ==> 0xF80060C8[0:0] = 0x00000000U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. ECC_CORRECTED_BIT_NUM = 0x0
// .. .. ==> 0xF80060C8[7:1] = 0x00000000U
// .. .. ==> MASK : 0x000000FEU VAL : 0x00000000U
// .. ..
MaskWrite(0xF80060C8, 0x000000FF, 0x00000000),
// .. .. UNCORR_ECC_LOG_VALID = 0x0
// .. .. ==> 0xF80060DC[0:0] = 0x00000000U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. ..
MaskWrite(0xF80060DC, 0x00000001, 0x00000000),
// .. .. STAT_NUM_CORR_ERR = 0x0
// .. .. ==> 0xF80060F0[15:8] = 0x00000000U
// .. .. ==> MASK : 0x0000FF00U VAL : 0x00000000U
// .. .. STAT_NUM_UNCORR_ERR = 0x0
// .. .. ==> 0xF80060F0[7:0] = 0x00000000U
// .. .. ==> MASK : 0x000000FFU VAL : 0x00000000U
// .. ..
MaskWrite(0xF80060F0, 0x0000FFFF, 0x00000000),
// .. .. reg_ddrc_ecc_mode = 0x0
// .. .. ==> 0xF80060F4[2:0] = 0x00000000U
// .. .. ==> MASK : 0x00000007U VAL : 0x00000000U
// .. .. reg_ddrc_dis_scrub = 0x1
// .. .. ==> 0xF80060F4[3:3] = 0x00000001U
// .. .. ==> MASK : 0x00000008U VAL : 0x00000008U
// .. ..
MaskWrite(0xF80060F4, 0x0000000F, 0x00000008),
// .. .. reg_phy_dif_on = 0x0
// .. .. ==> 0xF8006114[3:0] = 0x00000000U
// .. .. ==> MASK : 0x0000000FU VAL : 0x00000000U
// .. .. reg_phy_dif_off = 0x0
// .. .. ==> 0xF8006114[7:4] = 0x00000000U
// .. .. ==> MASK : 0x000000F0U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006114, 0x000000FF, 0x00000000),
// .. .. reg_phy_data_slice_in_use = 0x1
// .. .. ==> 0xF8006118[0:0] = 0x00000001U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. reg_phy_rdlvl_inc_mode = 0x0
// .. .. ==> 0xF8006118[1:1] = 0x00000000U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. .. reg_phy_gatelvl_inc_mode = 0x0
// .. .. ==> 0xF8006118[2:2] = 0x00000000U
// .. .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. .. reg_phy_wrlvl_inc_mode = 0x0
// .. .. ==> 0xF8006118[3:3] = 0x00000000U
// .. .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. .. reg_phy_bist_shift_dq = 0x0
// .. .. ==> 0xF8006118[14:6] = 0x00000000U
// .. .. ==> MASK : 0x00007FC0U VAL : 0x00000000U
// .. .. reg_phy_bist_err_clr = 0x0
// .. .. ==> 0xF8006118[23:15] = 0x00000000U
// .. .. ==> MASK : 0x00FF8000U VAL : 0x00000000U
// .. .. reg_phy_dq_offset = 0x40
// .. .. ==> 0xF8006118[30:24] = 0x00000040U
// .. .. ==> MASK : 0x7F000000U VAL : 0x40000000U
// .. ..
MaskWrite(0xF8006118, 0x7FFFFFCF, 0x40000001),
// .. .. reg_phy_data_slice_in_use = 0x1
// .. .. ==> 0xF800611C[0:0] = 0x00000001U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. reg_phy_rdlvl_inc_mode = 0x0
// .. .. ==> 0xF800611C[1:1] = 0x00000000U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. .. reg_phy_gatelvl_inc_mode = 0x0
// .. .. ==> 0xF800611C[2:2] = 0x00000000U
// .. .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. .. reg_phy_wrlvl_inc_mode = 0x0
// .. .. ==> 0xF800611C[3:3] = 0x00000000U
// .. .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. .. reg_phy_bist_shift_dq = 0x0
// .. .. ==> 0xF800611C[14:6] = 0x00000000U
// .. .. ==> MASK : 0x00007FC0U VAL : 0x00000000U
// .. .. reg_phy_bist_err_clr = 0x0
// .. .. ==> 0xF800611C[23:15] = 0x00000000U
// .. .. ==> MASK : 0x00FF8000U VAL : 0x00000000U
// .. .. reg_phy_dq_offset = 0x40
// .. .. ==> 0xF800611C[30:24] = 0x00000040U
// .. .. ==> MASK : 0x7F000000U VAL : 0x40000000U
// .. ..
MaskWrite(0xF800611C, 0x7FFFFFCF, 0x40000001),
// .. .. reg_phy_data_slice_in_use = 0x1
// .. .. ==> 0xF8006120[0:0] = 0x00000001U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. reg_phy_rdlvl_inc_mode = 0x0
// .. .. ==> 0xF8006120[1:1] = 0x00000000U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. .. reg_phy_gatelvl_inc_mode = 0x0
// .. .. ==> 0xF8006120[2:2] = 0x00000000U
// .. .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. .. reg_phy_wrlvl_inc_mode = 0x0
// .. .. ==> 0xF8006120[3:3] = 0x00000000U
// .. .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. .. reg_phy_bist_shift_dq = 0x0
// .. .. ==> 0xF8006120[14:6] = 0x00000000U
// .. .. ==> MASK : 0x00007FC0U VAL : 0x00000000U
// .. .. reg_phy_bist_err_clr = 0x0
// .. .. ==> 0xF8006120[23:15] = 0x00000000U
// .. .. ==> MASK : 0x00FF8000U VAL : 0x00000000U
// .. .. reg_phy_dq_offset = 0x40
// .. .. ==> 0xF8006120[30:24] = 0x00000040U
// .. .. ==> MASK : 0x7F000000U VAL : 0x40000000U
// .. ..
MaskWrite(0xF8006120, 0x7FFFFFCF, 0x40000001),
// .. .. reg_phy_data_slice_in_use = 0x1
// .. .. ==> 0xF8006124[0:0] = 0x00000001U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. reg_phy_rdlvl_inc_mode = 0x0
// .. .. ==> 0xF8006124[1:1] = 0x00000000U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. .. reg_phy_gatelvl_inc_mode = 0x0
// .. .. ==> 0xF8006124[2:2] = 0x00000000U
// .. .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. .. reg_phy_wrlvl_inc_mode = 0x0
// .. .. ==> 0xF8006124[3:3] = 0x00000000U
// .. .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. .. reg_phy_bist_shift_dq = 0x0
// .. .. ==> 0xF8006124[14:6] = 0x00000000U
// .. .. ==> MASK : 0x00007FC0U VAL : 0x00000000U
// .. .. reg_phy_bist_err_clr = 0x0
// .. .. ==> 0xF8006124[23:15] = 0x00000000U
// .. .. ==> MASK : 0x00FF8000U VAL : 0x00000000U
// .. .. reg_phy_dq_offset = 0x40
// .. .. ==> 0xF8006124[30:24] = 0x00000040U
// .. .. ==> MASK : 0x7F000000U VAL : 0x40000000U
// .. ..
MaskWrite(0xF8006124, 0x7FFFFFCF, 0x40000001),
// .. .. reg_phy_wrlvl_init_ratio = 0x1d
// .. .. ==> 0xF800612C[9:0] = 0x0000001DU
// .. .. ==> MASK : 0x000003FFU VAL : 0x0000001DU
// .. .. reg_phy_gatelvl_init_ratio = 0xf2
// .. .. ==> 0xF800612C[19:10] = 0x000000F2U
// .. .. ==> MASK : 0x000FFC00U VAL : 0x0003C800U
// .. ..
MaskWrite(0xF800612C, 0x000FFFFF, 0x0003C81D),
// .. .. reg_phy_wrlvl_init_ratio = 0x12
// .. .. ==> 0xF8006130[9:0] = 0x00000012U
// .. .. ==> MASK : 0x000003FFU VAL : 0x00000012U
// .. .. reg_phy_gatelvl_init_ratio = 0xd8
// .. .. ==> 0xF8006130[19:10] = 0x000000D8U
// .. .. ==> MASK : 0x000FFC00U VAL : 0x00036000U
// .. ..
MaskWrite(0xF8006130, 0x000FFFFF, 0x00036012),
// .. .. reg_phy_wrlvl_init_ratio = 0xc
// .. .. ==> 0xF8006134[9:0] = 0x0000000CU
// .. .. ==> MASK : 0x000003FFU VAL : 0x0000000CU
// .. .. reg_phy_gatelvl_init_ratio = 0xde
// .. .. ==> 0xF8006134[19:10] = 0x000000DEU
// .. .. ==> MASK : 0x000FFC00U VAL : 0x00037800U
// .. ..
MaskWrite(0xF8006134, 0x000FFFFF, 0x0003780C),
// .. .. reg_phy_wrlvl_init_ratio = 0x21
// .. .. ==> 0xF8006138[9:0] = 0x00000021U
// .. .. ==> MASK : 0x000003FFU VAL : 0x00000021U
// .. .. reg_phy_gatelvl_init_ratio = 0xee
// .. .. ==> 0xF8006138[19:10] = 0x000000EEU
// .. .. ==> MASK : 0x000FFC00U VAL : 0x0003B800U
// .. ..
MaskWrite(0xF8006138, 0x000FFFFF, 0x0003B821),
// .. .. reg_phy_rd_dqs_slave_ratio = 0x35
// .. .. ==> 0xF8006140[9:0] = 0x00000035U
// .. .. ==> MASK : 0x000003FFU VAL : 0x00000035U
// .. .. reg_phy_rd_dqs_slave_force = 0x0
// .. .. ==> 0xF8006140[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_rd_dqs_slave_delay = 0x0
// .. .. ==> 0xF8006140[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006140, 0x000FFFFF, 0x00000035),
// .. .. reg_phy_rd_dqs_slave_ratio = 0x35
// .. .. ==> 0xF8006144[9:0] = 0x00000035U
// .. .. ==> MASK : 0x000003FFU VAL : 0x00000035U
// .. .. reg_phy_rd_dqs_slave_force = 0x0
// .. .. ==> 0xF8006144[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_rd_dqs_slave_delay = 0x0
// .. .. ==> 0xF8006144[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006144, 0x000FFFFF, 0x00000035),
// .. .. reg_phy_rd_dqs_slave_ratio = 0x35
// .. .. ==> 0xF8006148[9:0] = 0x00000035U
// .. .. ==> MASK : 0x000003FFU VAL : 0x00000035U
// .. .. reg_phy_rd_dqs_slave_force = 0x0
// .. .. ==> 0xF8006148[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_rd_dqs_slave_delay = 0x0
// .. .. ==> 0xF8006148[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006148, 0x000FFFFF, 0x00000035),
// .. .. reg_phy_rd_dqs_slave_ratio = 0x35
// .. .. ==> 0xF800614C[9:0] = 0x00000035U
// .. .. ==> MASK : 0x000003FFU VAL : 0x00000035U
// .. .. reg_phy_rd_dqs_slave_force = 0x0
// .. .. ==> 0xF800614C[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_rd_dqs_slave_delay = 0x0
// .. .. ==> 0xF800614C[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF800614C, 0x000FFFFF, 0x00000035),
// .. .. reg_phy_wr_dqs_slave_ratio = 0x9d
// .. .. ==> 0xF8006154[9:0] = 0x0000009DU
// .. .. ==> MASK : 0x000003FFU VAL : 0x0000009DU
// .. .. reg_phy_wr_dqs_slave_force = 0x0
// .. .. ==> 0xF8006154[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_wr_dqs_slave_delay = 0x0
// .. .. ==> 0xF8006154[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006154, 0x000FFFFF, 0x0000009D),
// .. .. reg_phy_wr_dqs_slave_ratio = 0x92
// .. .. ==> 0xF8006158[9:0] = 0x00000092U
// .. .. ==> MASK : 0x000003FFU VAL : 0x00000092U
// .. .. reg_phy_wr_dqs_slave_force = 0x0
// .. .. ==> 0xF8006158[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_wr_dqs_slave_delay = 0x0
// .. .. ==> 0xF8006158[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006158, 0x000FFFFF, 0x00000092),
// .. .. reg_phy_wr_dqs_slave_ratio = 0x8c
// .. .. ==> 0xF800615C[9:0] = 0x0000008CU
// .. .. ==> MASK : 0x000003FFU VAL : 0x0000008CU
// .. .. reg_phy_wr_dqs_slave_force = 0x0
// .. .. ==> 0xF800615C[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_wr_dqs_slave_delay = 0x0
// .. .. ==> 0xF800615C[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF800615C, 0x000FFFFF, 0x0000008C),
// .. .. reg_phy_wr_dqs_slave_ratio = 0xa1
// .. .. ==> 0xF8006160[9:0] = 0x000000A1U
// .. .. ==> MASK : 0x000003FFU VAL : 0x000000A1U
// .. .. reg_phy_wr_dqs_slave_force = 0x0
// .. .. ==> 0xF8006160[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_wr_dqs_slave_delay = 0x0
// .. .. ==> 0xF8006160[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006160, 0x000FFFFF, 0x000000A1),
// .. .. reg_phy_fifo_we_slave_ratio = 0x147
// .. .. ==> 0xF8006168[10:0] = 0x00000147U
// .. .. ==> MASK : 0x000007FFU VAL : 0x00000147U
// .. .. reg_phy_fifo_we_in_force = 0x0
// .. .. ==> 0xF8006168[11:11] = 0x00000000U
// .. .. ==> MASK : 0x00000800U VAL : 0x00000000U
// .. .. reg_phy_fifo_we_in_delay = 0x0
// .. .. ==> 0xF8006168[20:12] = 0x00000000U
// .. .. ==> MASK : 0x001FF000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006168, 0x001FFFFF, 0x00000147),
// .. .. reg_phy_fifo_we_slave_ratio = 0x12d
// .. .. ==> 0xF800616C[10:0] = 0x0000012DU
// .. .. ==> MASK : 0x000007FFU VAL : 0x0000012DU
// .. .. reg_phy_fifo_we_in_force = 0x0
// .. .. ==> 0xF800616C[11:11] = 0x00000000U
// .. .. ==> MASK : 0x00000800U VAL : 0x00000000U
// .. .. reg_phy_fifo_we_in_delay = 0x0
// .. .. ==> 0xF800616C[20:12] = 0x00000000U
// .. .. ==> MASK : 0x001FF000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF800616C, 0x001FFFFF, 0x0000012D),
// .. .. reg_phy_fifo_we_slave_ratio = 0x133
// .. .. ==> 0xF8006170[10:0] = 0x00000133U
// .. .. ==> MASK : 0x000007FFU VAL : 0x00000133U
// .. .. reg_phy_fifo_we_in_force = 0x0
// .. .. ==> 0xF8006170[11:11] = 0x00000000U
// .. .. ==> MASK : 0x00000800U VAL : 0x00000000U
// .. .. reg_phy_fifo_we_in_delay = 0x0
// .. .. ==> 0xF8006170[20:12] = 0x00000000U
// .. .. ==> MASK : 0x001FF000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006170, 0x001FFFFF, 0x00000133),
// .. .. reg_phy_fifo_we_slave_ratio = 0x143
// .. .. ==> 0xF8006174[10:0] = 0x00000143U
// .. .. ==> MASK : 0x000007FFU VAL : 0x00000143U
// .. .. reg_phy_fifo_we_in_force = 0x0
// .. .. ==> 0xF8006174[11:11] = 0x00000000U
// .. .. ==> MASK : 0x00000800U VAL : 0x00000000U
// .. .. reg_phy_fifo_we_in_delay = 0x0
// .. .. ==> 0xF8006174[20:12] = 0x00000000U
// .. .. ==> MASK : 0x001FF000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006174, 0x001FFFFF, 0x00000143),
// .. .. reg_phy_wr_data_slave_ratio = 0xdd
// .. .. ==> 0xF800617C[9:0] = 0x000000DDU
// .. .. ==> MASK : 0x000003FFU VAL : 0x000000DDU
// .. .. reg_phy_wr_data_slave_force = 0x0
// .. .. ==> 0xF800617C[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_wr_data_slave_delay = 0x0
// .. .. ==> 0xF800617C[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF800617C, 0x000FFFFF, 0x000000DD),
// .. .. reg_phy_wr_data_slave_ratio = 0xd2
// .. .. ==> 0xF8006180[9:0] = 0x000000D2U
// .. .. ==> MASK : 0x000003FFU VAL : 0x000000D2U
// .. .. reg_phy_wr_data_slave_force = 0x0
// .. .. ==> 0xF8006180[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_wr_data_slave_delay = 0x0
// .. .. ==> 0xF8006180[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006180, 0x000FFFFF, 0x000000D2),
// .. .. reg_phy_wr_data_slave_ratio = 0xcc
// .. .. ==> 0xF8006184[9:0] = 0x000000CCU
// .. .. ==> MASK : 0x000003FFU VAL : 0x000000CCU
// .. .. reg_phy_wr_data_slave_force = 0x0
// .. .. ==> 0xF8006184[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_wr_data_slave_delay = 0x0
// .. .. ==> 0xF8006184[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006184, 0x000FFFFF, 0x000000CC),
// .. .. reg_phy_wr_data_slave_ratio = 0xe1
// .. .. ==> 0xF8006188[9:0] = 0x000000E1U
// .. .. ==> MASK : 0x000003FFU VAL : 0x000000E1U
// .. .. reg_phy_wr_data_slave_force = 0x0
// .. .. ==> 0xF8006188[10:10] = 0x00000000U
// .. .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. .. reg_phy_wr_data_slave_delay = 0x0
// .. .. ==> 0xF8006188[19:11] = 0x00000000U
// .. .. ==> MASK : 0x000FF800U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006188, 0x000FFFFF, 0x000000E1),
// .. .. reg_phy_bl2 = 0x0
// .. .. ==> 0xF8006190[1:1] = 0x00000000U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. .. reg_phy_at_spd_atpg = 0x0
// .. .. ==> 0xF8006190[2:2] = 0x00000000U
// .. .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. .. reg_phy_bist_enable = 0x0
// .. .. ==> 0xF8006190[3:3] = 0x00000000U
// .. .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. .. reg_phy_bist_force_err = 0x0
// .. .. ==> 0xF8006190[4:4] = 0x00000000U
// .. .. ==> MASK : 0x00000010U VAL : 0x00000000U
// .. .. reg_phy_bist_mode = 0x0
// .. .. ==> 0xF8006190[6:5] = 0x00000000U
// .. .. ==> MASK : 0x00000060U VAL : 0x00000000U
// .. .. reg_phy_invert_clkout = 0x1
// .. .. ==> 0xF8006190[7:7] = 0x00000001U
// .. .. ==> MASK : 0x00000080U VAL : 0x00000080U
// .. .. reg_phy_sel_logic = 0x0
// .. .. ==> 0xF8006190[9:9] = 0x00000000U
// .. .. ==> MASK : 0x00000200U VAL : 0x00000000U
// .. .. reg_phy_ctrl_slave_ratio = 0x100
// .. .. ==> 0xF8006190[19:10] = 0x00000100U
// .. .. ==> MASK : 0x000FFC00U VAL : 0x00040000U
// .. .. reg_phy_ctrl_slave_force = 0x0
// .. .. ==> 0xF8006190[20:20] = 0x00000000U
// .. .. ==> MASK : 0x00100000U VAL : 0x00000000U
// .. .. reg_phy_ctrl_slave_delay = 0x0
// .. .. ==> 0xF8006190[27:21] = 0x00000000U
// .. .. ==> MASK : 0x0FE00000U VAL : 0x00000000U
// .. .. reg_phy_lpddr = 0x0
// .. .. ==> 0xF8006190[29:29] = 0x00000000U
// .. .. ==> MASK : 0x20000000U VAL : 0x00000000U
// .. .. reg_phy_cmd_latency = 0x0
// .. .. ==> 0xF8006190[30:30] = 0x00000000U
// .. .. ==> MASK : 0x40000000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006190, 0x6FFFFEFE, 0x00040080),
// .. .. reg_phy_wr_rl_delay = 0x2
// .. .. ==> 0xF8006194[4:0] = 0x00000002U
// .. .. ==> MASK : 0x0000001FU VAL : 0x00000002U
// .. .. reg_phy_rd_rl_delay = 0x4
// .. .. ==> 0xF8006194[9:5] = 0x00000004U
// .. .. ==> MASK : 0x000003E0U VAL : 0x00000080U
// .. .. reg_phy_dll_lock_diff = 0xf
// .. .. ==> 0xF8006194[13:10] = 0x0000000FU
// .. .. ==> MASK : 0x00003C00U VAL : 0x00003C00U
// .. .. reg_phy_use_wr_level = 0x1
// .. .. ==> 0xF8006194[14:14] = 0x00000001U
// .. .. ==> MASK : 0x00004000U VAL : 0x00004000U
// .. .. reg_phy_use_rd_dqs_gate_level = 0x1
// .. .. ==> 0xF8006194[15:15] = 0x00000001U
// .. .. ==> MASK : 0x00008000U VAL : 0x00008000U
// .. .. reg_phy_use_rd_data_eye_level = 0x1
// .. .. ==> 0xF8006194[16:16] = 0x00000001U
// .. .. ==> MASK : 0x00010000U VAL : 0x00010000U
// .. .. reg_phy_dis_calib_rst = 0x0
// .. .. ==> 0xF8006194[17:17] = 0x00000000U
// .. .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. .. reg_phy_ctrl_slave_delay = 0x0
// .. .. ==> 0xF8006194[19:18] = 0x00000000U
// .. .. ==> MASK : 0x000C0000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006194, 0x000FFFFF, 0x0001FC82),
// .. .. reg_arb_page_addr_mask = 0x0
// .. .. ==> 0xF8006204[31:0] = 0x00000000U
// .. .. ==> MASK : 0xFFFFFFFFU VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006204, 0xFFFFFFFF, 0x00000000),
// .. .. reg_arb_pri_wr_portn = 0x3ff
// .. .. ==> 0xF8006208[9:0] = 0x000003FFU
// .. .. ==> MASK : 0x000003FFU VAL : 0x000003FFU
// .. .. reg_arb_disable_aging_wr_portn = 0x0
// .. .. ==> 0xF8006208[16:16] = 0x00000000U
// .. .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. .. reg_arb_disable_urgent_wr_portn = 0x0
// .. .. ==> 0xF8006208[17:17] = 0x00000000U
// .. .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. .. reg_arb_dis_page_match_wr_portn = 0x0
// .. .. ==> 0xF8006208[18:18] = 0x00000000U
// .. .. ==> MASK : 0x00040000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006208, 0x000703FF, 0x000003FF),
// .. .. reg_arb_pri_wr_portn = 0x3ff
// .. .. ==> 0xF800620C[9:0] = 0x000003FFU
// .. .. ==> MASK : 0x000003FFU VAL : 0x000003FFU
// .. .. reg_arb_disable_aging_wr_portn = 0x0
// .. .. ==> 0xF800620C[16:16] = 0x00000000U
// .. .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. .. reg_arb_disable_urgent_wr_portn = 0x0
// .. .. ==> 0xF800620C[17:17] = 0x00000000U
// .. .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. .. reg_arb_dis_page_match_wr_portn = 0x0
// .. .. ==> 0xF800620C[18:18] = 0x00000000U
// .. .. ==> MASK : 0x00040000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF800620C, 0x000703FF, 0x000003FF),
// .. .. reg_arb_pri_wr_portn = 0x3ff
// .. .. ==> 0xF8006210[9:0] = 0x000003FFU
// .. .. ==> MASK : 0x000003FFU VAL : 0x000003FFU
// .. .. reg_arb_disable_aging_wr_portn = 0x0
// .. .. ==> 0xF8006210[16:16] = 0x00000000U
// .. .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. .. reg_arb_disable_urgent_wr_portn = 0x0
// .. .. ==> 0xF8006210[17:17] = 0x00000000U
// .. .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. .. reg_arb_dis_page_match_wr_portn = 0x0
// .. .. ==> 0xF8006210[18:18] = 0x00000000U
// .. .. ==> MASK : 0x00040000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006210, 0x000703FF, 0x000003FF),
// .. .. reg_arb_pri_wr_portn = 0x3ff
// .. .. ==> 0xF8006214[9:0] = 0x000003FFU
// .. .. ==> MASK : 0x000003FFU VAL : 0x000003FFU
// .. .. reg_arb_disable_aging_wr_portn = 0x0
// .. .. ==> 0xF8006214[16:16] = 0x00000000U
// .. .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. .. reg_arb_disable_urgent_wr_portn = 0x0
// .. .. ==> 0xF8006214[17:17] = 0x00000000U
// .. .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. .. reg_arb_dis_page_match_wr_portn = 0x0
// .. .. ==> 0xF8006214[18:18] = 0x00000000U
// .. .. ==> MASK : 0x00040000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006214, 0x000703FF, 0x000003FF),
// .. .. reg_arb_pri_rd_portn = 0x3ff
// .. .. ==> 0xF8006218[9:0] = 0x000003FFU
// .. .. ==> MASK : 0x000003FFU VAL : 0x000003FFU
// .. .. reg_arb_disable_aging_rd_portn = 0x0
// .. .. ==> 0xF8006218[16:16] = 0x00000000U
// .. .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. .. reg_arb_disable_urgent_rd_portn = 0x0
// .. .. ==> 0xF8006218[17:17] = 0x00000000U
// .. .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. .. reg_arb_dis_page_match_rd_portn = 0x0
// .. .. ==> 0xF8006218[18:18] = 0x00000000U
// .. .. ==> MASK : 0x00040000U VAL : 0x00000000U
// .. .. reg_arb_set_hpr_rd_portn = 0x0
// .. .. ==> 0xF8006218[19:19] = 0x00000000U
// .. .. ==> MASK : 0x00080000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006218, 0x000F03FF, 0x000003FF),
// .. .. reg_arb_pri_rd_portn = 0x3ff
// .. .. ==> 0xF800621C[9:0] = 0x000003FFU
// .. .. ==> MASK : 0x000003FFU VAL : 0x000003FFU
// .. .. reg_arb_disable_aging_rd_portn = 0x0
// .. .. ==> 0xF800621C[16:16] = 0x00000000U
// .. .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. .. reg_arb_disable_urgent_rd_portn = 0x0
// .. .. ==> 0xF800621C[17:17] = 0x00000000U
// .. .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. .. reg_arb_dis_page_match_rd_portn = 0x0
// .. .. ==> 0xF800621C[18:18] = 0x00000000U
// .. .. ==> MASK : 0x00040000U VAL : 0x00000000U
// .. .. reg_arb_set_hpr_rd_portn = 0x0
// .. .. ==> 0xF800621C[19:19] = 0x00000000U
// .. .. ==> MASK : 0x00080000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF800621C, 0x000F03FF, 0x000003FF),
// .. .. reg_arb_pri_rd_portn = 0x3ff
// .. .. ==> 0xF8006220[9:0] = 0x000003FFU
// .. .. ==> MASK : 0x000003FFU VAL : 0x000003FFU
// .. .. reg_arb_disable_aging_rd_portn = 0x0
// .. .. ==> 0xF8006220[16:16] = 0x00000000U
// .. .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. .. reg_arb_disable_urgent_rd_portn = 0x0
// .. .. ==> 0xF8006220[17:17] = 0x00000000U
// .. .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. .. reg_arb_dis_page_match_rd_portn = 0x0
// .. .. ==> 0xF8006220[18:18] = 0x00000000U
// .. .. ==> MASK : 0x00040000U VAL : 0x00000000U
// .. .. reg_arb_set_hpr_rd_portn = 0x0
// .. .. ==> 0xF8006220[19:19] = 0x00000000U
// .. .. ==> MASK : 0x00080000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006220, 0x000F03FF, 0x000003FF),
// .. .. reg_arb_pri_rd_portn = 0x3ff
// .. .. ==> 0xF8006224[9:0] = 0x000003FFU
// .. .. ==> MASK : 0x000003FFU VAL : 0x000003FFU
// .. .. reg_arb_disable_aging_rd_portn = 0x0
// .. .. ==> 0xF8006224[16:16] = 0x00000000U
// .. .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. .. reg_arb_disable_urgent_rd_portn = 0x0
// .. .. ==> 0xF8006224[17:17] = 0x00000000U
// .. .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. .. reg_arb_dis_page_match_rd_portn = 0x0
// .. .. ==> 0xF8006224[18:18] = 0x00000000U
// .. .. ==> MASK : 0x00040000U VAL : 0x00000000U
// .. .. reg_arb_set_hpr_rd_portn = 0x0
// .. .. ==> 0xF8006224[19:19] = 0x00000000U
// .. .. ==> MASK : 0x00080000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006224, 0x000F03FF, 0x000003FF),
// .. .. reg_ddrc_lpddr2 = 0x0
// .. .. ==> 0xF80062A8[0:0] = 0x00000000U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000000U
// .. .. reg_ddrc_derate_enable = 0x0
// .. .. ==> 0xF80062A8[2:2] = 0x00000000U
// .. .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. .. reg_ddrc_mr4_margin = 0x0
// .. .. ==> 0xF80062A8[11:4] = 0x00000000U
// .. .. ==> MASK : 0x00000FF0U VAL : 0x00000000U
// .. ..
MaskWrite(0xF80062A8, 0x00000FF5, 0x00000000),
// .. .. reg_ddrc_mr4_read_interval = 0x0
// .. .. ==> 0xF80062AC[31:0] = 0x00000000U
// .. .. ==> MASK : 0xFFFFFFFFU VAL : 0x00000000U
// .. ..
MaskWrite(0xF80062AC, 0xFFFFFFFF, 0x00000000),
// .. .. reg_ddrc_min_stable_clock_x1 = 0x5
// .. .. ==> 0xF80062B0[3:0] = 0x00000005U
// .. .. ==> MASK : 0x0000000FU VAL : 0x00000005U
// .. .. reg_ddrc_idle_after_reset_x32 = 0x12
// .. .. ==> 0xF80062B0[11:4] = 0x00000012U
// .. .. ==> MASK : 0x00000FF0U VAL : 0x00000120U
// .. .. reg_ddrc_t_mrw = 0x5
// .. .. ==> 0xF80062B0[21:12] = 0x00000005U
// .. .. ==> MASK : 0x003FF000U VAL : 0x00005000U
// .. ..
MaskWrite(0xF80062B0, 0x003FFFFF, 0x00005125),
// .. .. reg_ddrc_max_auto_init_x1024 = 0xa8
// .. .. ==> 0xF80062B4[7:0] = 0x000000A8U
// .. .. ==> MASK : 0x000000FFU VAL : 0x000000A8U
// .. .. reg_ddrc_dev_zqinit_x32 = 0x12
// .. .. ==> 0xF80062B4[17:8] = 0x00000012U
// .. .. ==> MASK : 0x0003FF00U VAL : 0x00001200U
// .. ..
MaskWrite(0xF80062B4, 0x0003FFFF, 0x000012A8),
// .. .. START: POLL ON DCI STATUS
// .. .. DONE = 1
// .. .. ==> 0xF8000B74[13:13] = 0x00000001U
// .. .. ==> MASK : 0x00002000U VAL : 0x00002000U
// .. ..
MaskPoll(0xF8000B74, 0x00002000),
// .. .. FINISH: POLL ON DCI STATUS
// .. .. START: UNLOCK DDR
// .. .. reg_ddrc_soft_rstb = 0x1
// .. .. ==> 0xF8006000[0:0] = 0x00000001U
// .. .. ==> MASK : 0x00000001U VAL : 0x00000001U
// .. .. reg_ddrc_powerdown_en = 0x0
// .. .. ==> 0xF8006000[1:1] = 0x00000000U
// .. .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. .. reg_ddrc_data_bus_width = 0x0
// .. .. ==> 0xF8006000[3:2] = 0x00000000U
// .. .. ==> MASK : 0x0000000CU VAL : 0x00000000U
// .. .. reg_ddrc_burst8_refresh = 0x0
// .. .. ==> 0xF8006000[6:4] = 0x00000000U
// .. .. ==> MASK : 0x00000070U VAL : 0x00000000U
// .. .. reg_ddrc_rdwr_idle_gap = 1
// .. .. ==> 0xF8006000[13:7] = 0x00000001U
// .. .. ==> MASK : 0x00003F80U VAL : 0x00000080U
// .. .. reg_ddrc_dis_rd_bypass = 0x0
// .. .. ==> 0xF8006000[14:14] = 0x00000000U
// .. .. ==> MASK : 0x00004000U VAL : 0x00000000U
// .. .. reg_ddrc_dis_act_bypass = 0x0
// .. .. ==> 0xF8006000[15:15] = 0x00000000U
// .. .. ==> MASK : 0x00008000U VAL : 0x00000000U
// .. .. reg_ddrc_dis_auto_refresh = 0x0
// .. .. ==> 0xF8006000[16:16] = 0x00000000U
// .. .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. ..
MaskWrite(0xF8006000, 0x0001FFFF, 0x00000081),
// .. .. FINISH: UNLOCK DDR
// .. .. START: CHECK DDR STATUS
// .. .. ddrc_reg_operating_mode = 1
// .. .. ==> 0xF8006054[2:0] = 0x00000001U
// .. .. ==> MASK : 0x00000007U VAL : 0x00000001U
// .. ..
MaskPoll(0xF8006054, 0x00000007),
// .. .. FINISH: CHECK DDR STATUS
// .. FINISH: DDR INITIALIZATION
// FINISH: top
// *** ps7_peripherals_init_data_3_0 ***
// START: top
// .. START: SLCR SETTINGS
// .. UNLOCK_KEY = 0xDF0D
// .. ==> 0xF8000008[15:0] = 0x0000DF0DU
// .. ==> MASK : 0x0000FFFFU VAL : 0x0000DF0DU
// ..
MaskWrite(0xF8000008, 0x0000FFFF, 0x0000DF0D),
// .. FINISH: SLCR SETTINGS
// .. START: DDR TERM/IBUF_DISABLE_MODE SETTINGS
// .. IBUF_DISABLE_MODE = 0x1
// .. ==> 0xF8000B48[7:7] = 0x00000001U
// .. ==> MASK : 0x00000080U VAL : 0x00000080U
// .. TERM_DISABLE_MODE = 0x1
// .. ==> 0xF8000B48[8:8] = 0x00000001U
// .. ==> MASK : 0x00000100U VAL : 0x00000100U
// ..
MaskWrite(0xF8000B48, 0x00000180, 0x00000180),
// .. IBUF_DISABLE_MODE = 0x1
// .. ==> 0xF8000B4C[7:7] = 0x00000001U
// .. ==> MASK : 0x00000080U VAL : 0x00000080U
// .. TERM_DISABLE_MODE = 0x1
// .. ==> 0xF8000B4C[8:8] = 0x00000001U
// .. ==> MASK : 0x00000100U VAL : 0x00000100U
// ..
MaskWrite(0xF8000B4C, 0x00000180, 0x00000180),
// .. IBUF_DISABLE_MODE = 0x1
// .. ==> 0xF8000B50[7:7] = 0x00000001U
// .. ==> MASK : 0x00000080U VAL : 0x00000080U
// .. TERM_DISABLE_MODE = 0x1
// .. ==> 0xF8000B50[8:8] = 0x00000001U
// .. ==> MASK : 0x00000100U VAL : 0x00000100U
// ..
MaskWrite(0xF8000B50, 0x00000180, 0x00000180),
// .. IBUF_DISABLE_MODE = 0x1
// .. ==> 0xF8000B54[7:7] = 0x00000001U
// .. ==> MASK : 0x00000080U VAL : 0x00000080U
// .. TERM_DISABLE_MODE = 0x1
// .. ==> 0xF8000B54[8:8] = 0x00000001U
// .. ==> MASK : 0x00000100U VAL : 0x00000100U
// ..
MaskWrite(0xF8000B54, 0x00000180, 0x00000180),
// .. FINISH: DDR TERM/IBUF_DISABLE_MODE SETTINGS
// .. START: LOCK IT BACK
// .. LOCK_KEY = 0x767B
// .. ==> 0xF8000004[15:0] = 0x0000767BU
// .. ==> MASK : 0x0000FFFFU VAL : 0x0000767BU
// ..
MaskWrite(0xF8000004, 0x0000FFFF, 0x0000767B),
// .. FINISH: LOCK IT BACK
// .. START: SRAM/NOR SET OPMODE
// .. FINISH: SRAM/NOR SET OPMODE
// .. START: TRACE CURRENT PORT SIZE
// .. FINISH: TRACE CURRENT PORT SIZE
// .. START: UART REGISTERS
// .. BDIV = 0x6
// .. ==> 0xE0001034[7:0] = 0x00000006U
// .. ==> MASK : 0x000000FFU VAL : 0x00000006U
// ..
MaskWrite(0xE0001034, 0x000000FF, 0x00000006),
// .. CD = 0x3e
// .. ==> 0xE0001018[15:0] = 0x0000003EU
// .. ==> MASK : 0x0000FFFFU VAL : 0x0000003EU
// ..
MaskWrite(0xE0001018, 0x0000FFFF, 0x0000003E),
// .. STPBRK = 0x0
// .. ==> 0xE0001000[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. STTBRK = 0x0
// .. ==> 0xE0001000[7:7] = 0x00000000U
// .. ==> MASK : 0x00000080U VAL : 0x00000000U
// .. RSTTO = 0x0
// .. ==> 0xE0001000[6:6] = 0x00000000U
// .. ==> MASK : 0x00000040U VAL : 0x00000000U
// .. TXDIS = 0x0
// .. ==> 0xE0001000[5:5] = 0x00000000U
// .. ==> MASK : 0x00000020U VAL : 0x00000000U
// .. TXEN = 0x1
// .. ==> 0xE0001000[4:4] = 0x00000001U
// .. ==> MASK : 0x00000010U VAL : 0x00000010U
// .. RXDIS = 0x0
// .. ==> 0xE0001000[3:3] = 0x00000000U
// .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. RXEN = 0x1
// .. ==> 0xE0001000[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. TXRES = 0x1
// .. ==> 0xE0001000[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. RXRES = 0x1
// .. ==> 0xE0001000[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// ..
MaskWrite(0xE0001000, 0x000001FF, 0x00000017),
// .. CHMODE = 0x0
// .. ==> 0xE0001004[9:8] = 0x00000000U
// .. ==> MASK : 0x00000300U VAL : 0x00000000U
// .. NBSTOP = 0x0
// .. ==> 0xE0001004[7:6] = 0x00000000U
// .. ==> MASK : 0x000000C0U VAL : 0x00000000U
// .. PAR = 0x4
// .. ==> 0xE0001004[5:3] = 0x00000004U
// .. ==> MASK : 0x00000038U VAL : 0x00000020U
// .. CHRL = 0x0
// .. ==> 0xE0001004[2:1] = 0x00000000U
// .. ==> MASK : 0x00000006U VAL : 0x00000000U
// .. CLKS = 0x0
// .. ==> 0xE0001004[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// ..
MaskWrite(0xE0001004, 0x000003FF, 0x00000020),
// .. FINISH: UART REGISTERS
// .. START: QSPI REGISTERS
// .. Holdb_dr = 1
// .. ==> 0xE000D000[19:19] = 0x00000001U
// .. ==> MASK : 0x00080000U VAL : 0x00080000U
// ..
MaskWrite(0xE000D000, 0x00080000, 0x00080000),
// .. FINISH: QSPI REGISTERS
// .. START: PL POWER ON RESET REGISTERS
// .. PCFG_POR_CNT_4K = 0
// .. ==> 0xF8007000[29:29] = 0x00000000U
// .. ==> MASK : 0x20000000U VAL : 0x00000000U
// ..
MaskWrite(0xF8007000, 0x20000000, 0x00000000),
// .. FINISH: PL POWER ON RESET REGISTERS
// .. START: SMC TIMING CALCULATION REGISTER UPDATE
// .. .. START: NAND SET CYCLE
// .. .. FINISH: NAND SET CYCLE
// .. .. START: OPMODE
// .. .. FINISH: OPMODE
// .. .. START: DIRECT COMMAND
// .. .. FINISH: DIRECT COMMAND
// .. .. START: SRAM/NOR CS0 SET CYCLE
// .. .. FINISH: SRAM/NOR CS0 SET CYCLE
// .. .. START: DIRECT COMMAND
// .. .. FINISH: DIRECT COMMAND
// .. .. START: NOR CS0 BASE ADDRESS
// .. .. FINISH: NOR CS0 BASE ADDRESS
// .. .. START: SRAM/NOR CS1 SET CYCLE
// .. .. FINISH: SRAM/NOR CS1 SET CYCLE
// .. .. START: DIRECT COMMAND
// .. .. FINISH: DIRECT COMMAND
// .. .. START: NOR CS1 BASE ADDRESS
// .. .. FINISH: NOR CS1 BASE ADDRESS
// .. .. START: USB RESET
// .. .. .. START: DIR MODE BANK 0
// .. .. .. DIRECTION_0 = 0x2880
// .. .. .. ==> 0xE000A204[31:0] = 0x00002880U
// .. .. .. ==> MASK : 0xFFFFFFFFU VAL : 0x00002880U
// .. .. ..
MaskWrite(0xE000A204, 0xFFFFFFFF, 0x00002880),
// .. .. .. FINISH: DIR MODE BANK 0
// .. .. .. START: DIR MODE BANK 1
// .. .. .. FINISH: DIR MODE BANK 1
// .. .. .. START: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. MASK_0_LSW = 0xff7f
// .. .. .. ==> 0xE000A000[31:16] = 0x0000FF7FU
// .. .. .. ==> MASK : 0xFFFF0000U VAL : 0xFF7F0000U
// .. .. .. DATA_0_LSW = 0x80
// .. .. .. ==> 0xE000A000[15:0] = 0x00000080U
// .. .. .. ==> MASK : 0x0000FFFFU VAL : 0x00000080U
// .. .. ..
MaskWrite(0xE000A000, 0xFFFFFFFF, 0xFF7F0080),
// .. .. .. FINISH: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. START: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. FINISH: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. START: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. FINISH: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. START: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. .. FINISH: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. .. START: OUTPUT ENABLE BANK 0
// .. .. .. OP_ENABLE_0 = 0x2880
// .. .. .. ==> 0xE000A208[31:0] = 0x00002880U
// .. .. .. ==> MASK : 0xFFFFFFFFU VAL : 0x00002880U
// .. .. ..
MaskWrite(0xE000A208, 0xFFFFFFFF, 0x00002880),
// .. .. .. FINISH: OUTPUT ENABLE BANK 0
// .. .. .. START: OUTPUT ENABLE BANK 1
// .. .. .. FINISH: OUTPUT ENABLE BANK 1
// .. .. .. START: MASK_DATA_0_LSW LOW BANK [15:0]
// .. .. .. MASK_0_LSW = 0xff7f
// .. .. .. ==> 0xE000A000[31:16] = 0x0000FF7FU
// .. .. .. ==> MASK : 0xFFFF0000U VAL : 0xFF7F0000U
// .. .. .. DATA_0_LSW = 0x0
// .. .. .. ==> 0xE000A000[15:0] = 0x00000000U
// .. .. .. ==> MASK : 0x0000FFFFU VAL : 0x00000000U
// .. .. ..
MaskWrite(0xE000A000, 0xFFFFFFFF, 0xFF7F0000),
// .. .. .. FINISH: MASK_DATA_0_LSW LOW BANK [15:0]
// .. .. .. START: MASK_DATA_0_MSW LOW BANK [31:16]
// .. .. .. FINISH: MASK_DATA_0_MSW LOW BANK [31:16]
// .. .. .. START: MASK_DATA_1_LSW LOW BANK [47:32]
// .. .. .. FINISH: MASK_DATA_1_LSW LOW BANK [47:32]
// .. .. .. START: MASK_DATA_1_MSW LOW BANK [53:48]
// .. .. .. FINISH: MASK_DATA_1_MSW LOW BANK [53:48]
// .. .. .. START: ADD 1 MS DELAY
// .. .. ..
MaskDelay(0xF8F00200, 1),
// .. .. .. FINISH: ADD 1 MS DELAY
// .. .. .. START: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. MASK_0_LSW = 0xff7f
// .. .. .. ==> 0xE000A000[31:16] = 0x0000FF7FU
// .. .. .. ==> MASK : 0xFFFF0000U VAL : 0xFF7F0000U
// .. .. .. DATA_0_LSW = 0x80
// .. .. .. ==> 0xE000A000[15:0] = 0x00000080U
// .. .. .. ==> MASK : 0x0000FFFFU VAL : 0x00000080U
// .. .. ..
MaskWrite(0xE000A000, 0xFFFFFFFF, 0xFF7F0080),
// .. .. .. FINISH: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. START: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. FINISH: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. START: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. FINISH: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. START: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. .. FINISH: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. FINISH: USB RESET
// .. .. START: ENET RESET
// .. .. .. START: DIR MODE BANK 0
// .. .. .. DIRECTION_0 = 0x2880
// .. .. .. ==> 0xE000A204[31:0] = 0x00002880U
// .. .. .. ==> MASK : 0xFFFFFFFFU VAL : 0x00002880U
// .. .. ..
MaskWrite(0xE000A204, 0xFFFFFFFF, 0x00002880),
// .. .. .. FINISH: DIR MODE BANK 0
// .. .. .. START: DIR MODE BANK 1
// .. .. .. FINISH: DIR MODE BANK 1
// .. .. .. START: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. MASK_0_LSW = 0xf7ff
// .. .. .. ==> 0xE000A000[31:16] = 0x0000F7FFU
// .. .. .. ==> MASK : 0xFFFF0000U VAL : 0xF7FF0000U
// .. .. .. DATA_0_LSW = 0x800
// .. .. .. ==> 0xE000A000[15:0] = 0x00000800U
// .. .. .. ==> MASK : 0x0000FFFFU VAL : 0x00000800U
// .. .. ..
MaskWrite(0xE000A000, 0xFFFFFFFF, 0xF7FF0800),
// .. .. .. FINISH: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. START: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. FINISH: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. START: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. FINISH: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. START: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. .. FINISH: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. .. START: OUTPUT ENABLE BANK 0
// .. .. .. OP_ENABLE_0 = 0x2880
// .. .. .. ==> 0xE000A208[31:0] = 0x00002880U
// .. .. .. ==> MASK : 0xFFFFFFFFU VAL : 0x00002880U
// .. .. ..
MaskWrite(0xE000A208, 0xFFFFFFFF, 0x00002880),
// .. .. .. FINISH: OUTPUT ENABLE BANK 0
// .. .. .. START: OUTPUT ENABLE BANK 1
// .. .. .. FINISH: OUTPUT ENABLE BANK 1
// .. .. .. START: MASK_DATA_0_LSW LOW BANK [15:0]
// .. .. .. MASK_0_LSW = 0xf7ff
// .. .. .. ==> 0xE000A000[31:16] = 0x0000F7FFU
// .. .. .. ==> MASK : 0xFFFF0000U VAL : 0xF7FF0000U
// .. .. .. DATA_0_LSW = 0x0
// .. .. .. ==> 0xE000A000[15:0] = 0x00000000U
// .. .. .. ==> MASK : 0x0000FFFFU VAL : 0x00000000U
// .. .. ..
MaskWrite(0xE000A000, 0xFFFFFFFF, 0xF7FF0000),
// .. .. .. FINISH: MASK_DATA_0_LSW LOW BANK [15:0]
// .. .. .. START: MASK_DATA_0_MSW LOW BANK [31:16]
// .. .. .. FINISH: MASK_DATA_0_MSW LOW BANK [31:16]
// .. .. .. START: MASK_DATA_1_LSW LOW BANK [47:32]
// .. .. .. FINISH: MASK_DATA_1_LSW LOW BANK [47:32]
// .. .. .. START: MASK_DATA_1_MSW LOW BANK [53:48]
// .. .. .. FINISH: MASK_DATA_1_MSW LOW BANK [53:48]
// .. .. .. START: ADD 1 MS DELAY
// .. .. ..
MaskDelay(0xF8F00200, 1),
// .. .. .. FINISH: ADD 1 MS DELAY
// .. .. .. START: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. MASK_0_LSW = 0xf7ff
// .. .. .. ==> 0xE000A000[31:16] = 0x0000F7FFU
// .. .. .. ==> MASK : 0xFFFF0000U VAL : 0xF7FF0000U
// .. .. .. DATA_0_LSW = 0x800
// .. .. .. ==> 0xE000A000[15:0] = 0x00000800U
// .. .. .. ==> MASK : 0x0000FFFFU VAL : 0x00000800U
// .. .. ..
MaskWrite(0xE000A000, 0xFFFFFFFF, 0xF7FF0800),
// .. .. .. FINISH: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. START: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. FINISH: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. START: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. FINISH: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. START: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. .. FINISH: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. FINISH: ENET RESET
// .. .. START: I2C RESET
// .. .. .. START: DIR MODE GPIO BANK0
// .. .. .. DIRECTION_0 = 0x2880
// .. .. .. ==> 0xE000A204[31:0] = 0x00002880U
// .. .. .. ==> MASK : 0xFFFFFFFFU VAL : 0x00002880U
// .. .. ..
MaskWrite(0xE000A204, 0xFFFFFFFF, 0x00002880),
// .. .. .. FINISH: DIR MODE GPIO BANK0
// .. .. .. START: DIR MODE GPIO BANK1
// .. .. .. FINISH: DIR MODE GPIO BANK1
// .. .. .. START: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. MASK_0_LSW = 0xdfff
// .. .. .. ==> 0xE000A000[31:16] = 0x0000DFFFU
// .. .. .. ==> MASK : 0xFFFF0000U VAL : 0xDFFF0000U
// .. .. .. DATA_0_LSW = 0x2000
// .. .. .. ==> 0xE000A000[15:0] = 0x00002000U
// .. .. .. ==> MASK : 0x0000FFFFU VAL : 0x00002000U
// .. .. ..
MaskWrite(0xE000A000, 0xFFFFFFFF, 0xDFFF2000),
// .. .. .. FINISH: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. START: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. FINISH: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. START: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. FINISH: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. START: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. .. FINISH: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. .. START: OUTPUT ENABLE
// .. .. .. OP_ENABLE_0 = 0x2880
// .. .. .. ==> 0xE000A208[31:0] = 0x00002880U
// .. .. .. ==> MASK : 0xFFFFFFFFU VAL : 0x00002880U
// .. .. ..
MaskWrite(0xE000A208, 0xFFFFFFFF, 0x00002880),
// .. .. .. FINISH: OUTPUT ENABLE
// .. .. .. START: OUTPUT ENABLE
// .. .. .. FINISH: OUTPUT ENABLE
// .. .. .. START: MASK_DATA_0_LSW LOW BANK [15:0]
// .. .. .. MASK_0_LSW = 0xdfff
// .. .. .. ==> 0xE000A000[31:16] = 0x0000DFFFU
// .. .. .. ==> MASK : 0xFFFF0000U VAL : 0xDFFF0000U
// .. .. .. DATA_0_LSW = 0x0
// .. .. .. ==> 0xE000A000[15:0] = 0x00000000U
// .. .. .. ==> MASK : 0x0000FFFFU VAL : 0x00000000U
// .. .. ..
MaskWrite(0xE000A000, 0xFFFFFFFF, 0xDFFF0000),
// .. .. .. FINISH: MASK_DATA_0_LSW LOW BANK [15:0]
// .. .. .. START: MASK_DATA_0_MSW LOW BANK [31:16]
// .. .. .. FINISH: MASK_DATA_0_MSW LOW BANK [31:16]
// .. .. .. START: MASK_DATA_1_LSW LOW BANK [47:32]
// .. .. .. FINISH: MASK_DATA_1_LSW LOW BANK [47:32]
// .. .. .. START: MASK_DATA_1_MSW LOW BANK [53:48]
// .. .. .. FINISH: MASK_DATA_1_MSW LOW BANK [53:48]
// .. .. .. START: ADD 1 MS DELAY
// .. .. ..
MaskDelay(0xF8F00200, 1),
// .. .. .. FINISH: ADD 1 MS DELAY
// .. .. .. START: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. MASK_0_LSW = 0xdfff
// .. .. .. ==> 0xE000A000[31:16] = 0x0000DFFFU
// .. .. .. ==> MASK : 0xFFFF0000U VAL : 0xDFFF0000U
// .. .. .. DATA_0_LSW = 0x2000
// .. .. .. ==> 0xE000A000[15:0] = 0x00002000U
// .. .. .. ==> MASK : 0x0000FFFFU VAL : 0x00002000U
// .. .. ..
MaskWrite(0xE000A000, 0xFFFFFFFF, 0xDFFF2000),
// .. .. .. FINISH: MASK_DATA_0_LSW HIGH BANK [15:0]
// .. .. .. START: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. FINISH: MASK_DATA_0_MSW HIGH BANK [31:16]
// .. .. .. START: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. FINISH: MASK_DATA_1_LSW HIGH BANK [47:32]
// .. .. .. START: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. .. FINISH: MASK_DATA_1_MSW HIGH BANK [53:48]
// .. .. FINISH: I2C RESET
// .. FINISH: SMC TIMING CALCULATION REGISTER UPDATE
// FINISH: top
// *** ps7_post_config_3_0 ***
// START: top
// .. START: SLCR SETTINGS
// .. UNLOCK_KEY = 0xDF0D
// .. ==> 0xF8000008[15:0] = 0x0000DF0DU
// .. ==> MASK : 0x0000FFFFU VAL : 0x0000DF0DU
// ..
MaskWrite(0xF8000008, 0x0000FFFF, 0x0000DF0D),
// .. FINISH: SLCR SETTINGS
// .. START: ENABLING LEVEL SHIFTER
// .. USER_LVL_INP_EN_0 = 1
// .. ==> 0xF8000900[3:3] = 0x00000001U
// .. ==> MASK : 0x00000008U VAL : 0x00000008U
// .. USER_LVL_OUT_EN_0 = 1
// .. ==> 0xF8000900[2:2] = 0x00000001U
// .. ==> MASK : 0x00000004U VAL : 0x00000004U
// .. USER_LVL_INP_EN_1 = 1
// .. ==> 0xF8000900[1:1] = 0x00000001U
// .. ==> MASK : 0x00000002U VAL : 0x00000002U
// .. USER_LVL_OUT_EN_1 = 1
// .. ==> 0xF8000900[0:0] = 0x00000001U
// .. ==> MASK : 0x00000001U VAL : 0x00000001U
// ..
MaskWrite(0xF8000900, 0x0000000F, 0x0000000F),
// .. FINISH: ENABLING LEVEL SHIFTER
// .. START: FPGA RESETS TO 0
// .. reserved_3 = 0
// .. ==> 0xF8000240[31:25] = 0x00000000U
// .. ==> MASK : 0xFE000000U VAL : 0x00000000U
// .. reserved_FPGA_ACP_RST = 0
// .. ==> 0xF8000240[24:24] = 0x00000000U
// .. ==> MASK : 0x01000000U VAL : 0x00000000U
// .. reserved_FPGA_AXDS3_RST = 0
// .. ==> 0xF8000240[23:23] = 0x00000000U
// .. ==> MASK : 0x00800000U VAL : 0x00000000U
// .. reserved_FPGA_AXDS2_RST = 0
// .. ==> 0xF8000240[22:22] = 0x00000000U
// .. ==> MASK : 0x00400000U VAL : 0x00000000U
// .. reserved_FPGA_AXDS1_RST = 0
// .. ==> 0xF8000240[21:21] = 0x00000000U
// .. ==> MASK : 0x00200000U VAL : 0x00000000U
// .. reserved_FPGA_AXDS0_RST = 0
// .. ==> 0xF8000240[20:20] = 0x00000000U
// .. ==> MASK : 0x00100000U VAL : 0x00000000U
// .. reserved_2 = 0
// .. ==> 0xF8000240[19:18] = 0x00000000U
// .. ==> MASK : 0x000C0000U VAL : 0x00000000U
// .. reserved_FSSW1_FPGA_RST = 0
// .. ==> 0xF8000240[17:17] = 0x00000000U
// .. ==> MASK : 0x00020000U VAL : 0x00000000U
// .. reserved_FSSW0_FPGA_RST = 0
// .. ==> 0xF8000240[16:16] = 0x00000000U
// .. ==> MASK : 0x00010000U VAL : 0x00000000U
// .. reserved_1 = 0
// .. ==> 0xF8000240[15:14] = 0x00000000U
// .. ==> MASK : 0x0000C000U VAL : 0x00000000U
// .. reserved_FPGA_FMSW1_RST = 0
// .. ==> 0xF8000240[13:13] = 0x00000000U
// .. ==> MASK : 0x00002000U VAL : 0x00000000U
// .. reserved_FPGA_FMSW0_RST = 0
// .. ==> 0xF8000240[12:12] = 0x00000000U
// .. ==> MASK : 0x00001000U VAL : 0x00000000U
// .. reserved_FPGA_DMA3_RST = 0
// .. ==> 0xF8000240[11:11] = 0x00000000U
// .. ==> MASK : 0x00000800U VAL : 0x00000000U
// .. reserved_FPGA_DMA2_RST = 0
// .. ==> 0xF8000240[10:10] = 0x00000000U
// .. ==> MASK : 0x00000400U VAL : 0x00000000U
// .. reserved_FPGA_DMA1_RST = 0
// .. ==> 0xF8000240[9:9] = 0x00000000U
// .. ==> MASK : 0x00000200U VAL : 0x00000000U
// .. reserved_FPGA_DMA0_RST = 0
// .. ==> 0xF8000240[8:8] = 0x00000000U
// .. ==> MASK : 0x00000100U VAL : 0x00000000U
// .. reserved = 0
// .. ==> 0xF8000240[7:4] = 0x00000000U
// .. ==> MASK : 0x000000F0U VAL : 0x00000000U
// .. FPGA3_OUT_RST = 0
// .. ==> 0xF8000240[3:3] = 0x00000000U
// .. ==> MASK : 0x00000008U VAL : 0x00000000U
// .. FPGA2_OUT_RST = 0
// .. ==> 0xF8000240[2:2] = 0x00000000U
// .. ==> MASK : 0x00000004U VAL : 0x00000000U
// .. FPGA1_OUT_RST = 0
// .. ==> 0xF8000240[1:1] = 0x00000000U
// .. ==> MASK : 0x00000002U VAL : 0x00000000U
// .. FPGA0_OUT_RST = 0
// .. ==> 0xF8000240[0:0] = 0x00000000U
// .. ==> MASK : 0x00000001U VAL : 0x00000000U
// ..
MaskWrite(0xF8000240, 0xFFFFFFFF, 0x00000000),
// .. FINISH: FPGA RESETS TO 0
// .. START: AFI REGISTERS
// .. .. START: AFI0 REGISTERS
// .. .. FINISH: AFI0 REGISTERS
// .. .. START: AFI1 REGISTERS
// .. .. FINISH: AFI1 REGISTERS
// .. .. START: AFI2 REGISTERS
// .. .. FINISH: AFI2 REGISTERS
// .. .. START: AFI3 REGISTERS
// .. .. FINISH: AFI3 REGISTERS
// .. FINISH: AFI REGISTERS
// .. START: LOCK IT BACK
// .. LOCK_KEY = 0x767B
// .. ==> 0xF8000004[15:0] = 0x0000767BU
// .. ==> MASK : 0x0000FFFFU VAL : 0x0000767BU
// ..
MaskWrite(0xF8000004, 0x0000FFFF, 0x0000767B),
// .. FINISH: LOCK IT BACK
// FINISH: top
// *** ps7_debug_3_0 ***
// START: top
// .. START: CROSS TRIGGER CONFIGURATIONS
// .. .. START: UNLOCKING CTI REGISTERS
// .. .. KEY = 0xC5ACCE55
// .. .. ==> 0xF8898FB0[31:0] = 0xC5ACCE55U
// .. .. ==> MASK : 0xFFFFFFFFU VAL : 0xC5ACCE55U
// .. ..
MaskWrite(0xF8898FB0, 0xFFFFFFFF, 0xC5ACCE55),
// .. .. KEY = 0xC5ACCE55
// .. .. ==> 0xF8899FB0[31:0] = 0xC5ACCE55U
// .. .. ==> MASK : 0xFFFFFFFFU VAL : 0xC5ACCE55U
// .. ..
MaskWrite(0xF8899FB0, 0xFFFFFFFF, 0xC5ACCE55),
// .. .. KEY = 0xC5ACCE55
// .. .. ==> 0xF8809FB0[31:0] = 0xC5ACCE55U
// .. .. ==> MASK : 0xFFFFFFFFU VAL : 0xC5ACCE55U
// .. ..
MaskWrite(0xF8809FB0, 0xFFFFFFFF, 0xC5ACCE55),
// .. .. FINISH: UNLOCKING CTI REGISTERS
// .. .. START: ENABLING CTI MODULES AND CHANNELS
// .. .. FINISH: ENABLING CTI MODULES AND CHANNELS
// .. .. START: MAPPING CPU0, CPU1 AND FTM EVENTS TO CTM CHANNELS
// .. .. FINISH: MAPPING CPU0, CPU1 AND FTM EVENTS TO CTM CHANNELS
// .. FINISH: CROSS TRIGGER CONFIGURATIONS
// FINISH: top
];
Reference in New Issue View Git Blame Copy Permalink