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3238dae99f
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@ -0,0 +1,228 @@
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use volatile_register::{RO, RW, WO};
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use libregister::{register, register_at, register_bit, register_bits, register_bits_typed};
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#[allow(unused)]
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#[repr(u8)]
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pub enum CommandType {
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Normal = 0b00,
|
||||||
|
Suspend = 0b01,
|
||||||
|
Resume = 0b10,
|
||||||
|
Abort = 0b11,
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}
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#[allow(unused)]
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#[repr(u8)]
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pub enum ResponseTypeSelect {
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NoResponse = 0b00,
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||||||
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Length136 = 0b01,
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||||||
|
Length48 = 0b10,
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||||||
|
Legnth48Check = 0b11,
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}
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#[repr(C)]
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pub struct RegisterBlock {
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pub sdma_system_address: RM<u32>,
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pub block_size_block_count: BockSizeBlockCount,
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||||||
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pub argument: RW<u32>,
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pub transfer_mode_command: TransferModeCommand,
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pub responses: [RO<u32>; 4],
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pub buffer: RW<u32>,
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pub present_state: PresentState,
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|
}
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register_at!(RegisterBlock, 0xE0100000, sd0);
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register_at!(RegisterBlock, 0xE0101000, sd1);
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register!(block_size_block_count, BlockSizeBlockCount, RW, u32);
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register_bits!(
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block_size_block_count,
|
||||||
|
/// Current transfer block count.
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||||||
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blocks_count,
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||||||
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u16,
|
||||||
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16,
|
||||||
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31
|
||||||
|
);
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register_bits!(
|
||||||
|
block_size_block_count,
|
||||||
|
/// Host SDMA Buffer Size, size = 2^(val + 2) KB.
|
||||||
|
dma_buffer_size,
|
||||||
|
u8,
|
||||||
|
12,
|
||||||
|
14
|
||||||
|
);
|
||||||
|
register_bits!(
|
||||||
|
block_size_block_count,
|
||||||
|
/// Block size for data transfer. Unit: byte.
|
||||||
|
transfer_block_size,
|
||||||
|
u16,
|
||||||
|
0,
|
||||||
|
11
|
||||||
|
);
|
||||||
|
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||||||
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|
||||||
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register!(transfer_mode_command, TransferModeCommand, RW, u32);
|
||||||
|
register_bits!(
|
||||||
|
transfer_mode_command,
|
||||||
|
/// Command Number.
|
||||||
|
command_index,
|
||||||
|
u8,
|
||||||
|
24,
|
||||||
|
29
|
||||||
|
);
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||||||
|
register_bits_typed!(
|
||||||
|
transfer_mode_command,
|
||||||
|
/// Command type register.
|
||||||
|
command_type,
|
||||||
|
u8,
|
||||||
|
CommandType,
|
||||||
|
24,
|
||||||
|
29
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
transfer_mode_command,
|
||||||
|
/// 1 if data is present and shall be transferred using the DAT line.
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||||||
|
data_present_select,
|
||||||
|
21
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
transfer_mode_command,
|
||||||
|
/// If the index field shall be checked.
|
||||||
|
index_check_en,
|
||||||
|
20
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
transfer_mode_command,
|
||||||
|
/// If CRC shall be checked.
|
||||||
|
crc_check_en,
|
||||||
|
19
|
||||||
|
);
|
||||||
|
register_bits_typed!(
|
||||||
|
transfer_mode_command,
|
||||||
|
/// Different type of response.
|
||||||
|
response_type_select,
|
||||||
|
u8,
|
||||||
|
ResponseTypeSelect,
|
||||||
|
16,
|
||||||
|
17
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
transfer_mode_command,
|
||||||
|
/// Enables the multi block DAT line data transfer.
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||||||
|
multi_block_en,
|
||||||
|
5
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
transfer_mode_command,
|
||||||
|
/// 1 if read (card to host), 0 if write (host to card).
|
||||||
|
direction_select,
|
||||||
|
4
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
transfer_mode_command,
|
||||||
|
/// If CMD12 shall be issued automatically when last block transfer is completed.
|
||||||
|
auto_cmd12_en,
|
||||||
|
2
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
transfer_mode_command,
|
||||||
|
/// Enable the block count register.
|
||||||
|
block_count_en,
|
||||||
|
1
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
transfer_mode_command,
|
||||||
|
/// Enable DMA,
|
||||||
|
dma_en,
|
||||||
|
0
|
||||||
|
);
|
||||||
|
|
||||||
|
|
||||||
|
register!(present_state, PresentState, RO, u32);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
/// CMD Line Signal Level.
|
||||||
|
cmd_line_level,
|
||||||
|
24
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
/// Signal level in DAT[3]
|
||||||
|
dat3_level,
|
||||||
|
23
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
/// Signal level in DAT[2]
|
||||||
|
dat2_level,
|
||||||
|
22
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
/// Signal level in DAT[1]
|
||||||
|
dat1_level,
|
||||||
|
21
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
/// Signal level in DAT[0]
|
||||||
|
dat0_level,
|
||||||
|
20
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
/// Write enabled and inverse of SDx_WP pin level.
|
||||||
|
write_enabled,
|
||||||
|
19
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
/// Card detected and inverse of SDx_CDn pin level.
|
||||||
|
card_detected,
|
||||||
|
18
|
||||||
|
);
|
||||||
|
regsiter_bit!(
|
||||||
|
present_state,
|
||||||
|
card_state_stable,
|
||||||
|
17
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
card_inserted,
|
||||||
|
16
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
buffer_read_en,
|
||||||
|
11,
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
buffer_write_en,
|
||||||
|
10
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
read_transfer_active,
|
||||||
|
9
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
write_transfer_active,
|
||||||
|
8
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
dat_line_active,
|
||||||
|
2
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
command_inhibit_dat,
|
||||||
|
1
|
||||||
|
);
|
||||||
|
register_bit!(
|
||||||
|
present_state,
|
||||||
|
command_inhibit_cmd,
|
||||||
|
0
|
||||||
|
);
|
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