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c99d70bf02
commit
8cbb3878e5
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@ -183,7 +183,8 @@ macro_rules! clear {
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}
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macro_rules! set_csr {
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($set_field:ident, $e:expr) => {
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($(#[$attr:meta])*, $set_field:ident, $e:expr) => {
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$(#[$attr])*
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#[inline]
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pub unsafe fn $set_field() {
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_set($e);
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@ -192,7 +193,8 @@ macro_rules! set_csr {
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}
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||||
macro_rules! clear_csr {
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||||
($clear_field:ident, $e:expr) => {
|
||||
($(#[$attr:meta])*, $clear_field:ident, $e:expr) => {
|
||||
$(#[$attr])*
|
||||
#[inline]
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||||
pub unsafe fn $clear_field() {
|
||||
_clear($e);
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||||
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@ -201,8 +203,8 @@ macro_rules! clear_csr {
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}
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||||
macro_rules! set_clear_csr {
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||||
($set_field:ident, $clear_field:ident, $e:expr) => {
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||||
set_csr!($set_field, $e);
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||||
clear_csr!($clear_field, $e);
|
||||
($(#[$attr:meta])*, $set_field:ident, $clear_field:ident, $e:expr) => {
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||||
set_csr!($(#[$attr])*, $set_field, $e);
|
||||
clear_csr!($(#[$attr])*, $clear_field, $e);
|
||||
}
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||||
}
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@ -72,21 +72,30 @@ read_csr_as!(Mie, 0x304, __read_mie);
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set!(0x304, __set_mie);
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clear!(0x304, __clear_mie);
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/// User Software Interrupt Enable
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set_clear_csr!(set_usoft, clear_usoft, 1 << 0);
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/// Supervisor Software Interrupt Enable
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set_clear_csr!(set_ssoft, clear_ssoft, 1 << 1);
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||||
/// Machine Software Interrupt Enable
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set_clear_csr!(set_msoft, clear_msoft, 1 << 3);
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/// User Timer Interrupt Enable
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set_clear_csr!(set_utimer, clear_utimer, 1 << 4);
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||||
/// Supervisor Timer Interrupt Enable
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set_clear_csr!(set_stimer, clear_stimer, 1 << 5);
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||||
/// Machine Timer Interrupt Enable
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set_clear_csr!(set_mtimer, clear_mtimer, 1 << 7);
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||||
/// User External Interrupt Enable
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set_clear_csr!(set_uext, clear_uext, 1 << 8);
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||||
/// Supervisor External Interrupt Enable
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set_clear_csr!(set_sext, clear_sext, 1 << 9);
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||||
/// Machine External Interrupt Enable
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set_clear_csr!(set_mext, clear_mext, 1 << 11);
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||||
set_clear_csr!(
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||||
/// User Software Interrupt Enable
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, set_usoft, clear_usoft, 1 << 0);
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set_clear_csr!(
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||||
/// Supervisor Software Interrupt Enable
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||||
, set_ssoft, clear_ssoft, 1 << 1);
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||||
set_clear_csr!(
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||||
/// Machine Software Interrupt Enable
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, set_msoft, clear_msoft, 1 << 3);
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||||
set_clear_csr!(
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||||
/// User Timer Interrupt Enable
|
||||
, set_utimer, clear_utimer, 1 << 4);
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||||
set_clear_csr!(
|
||||
/// Supervisor Timer Interrupt Enable
|
||||
, set_stimer, clear_stimer, 1 << 5);
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||||
set_clear_csr!(
|
||||
/// Machine Timer Interrupt Enable
|
||||
, set_mtimer, clear_mtimer, 1 << 7);
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||||
set_clear_csr!(
|
||||
/// User External Interrupt Enable
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||||
, set_uext, clear_uext, 1 << 8);
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||||
set_clear_csr!(
|
||||
/// Supervisor External Interrupt Enable
|
||||
, set_sext, clear_sext, 1 << 9);
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||||
set_clear_csr!(
|
||||
/// Machine External Interrupt Enable
|
||||
, set_mext, clear_mext, 1 << 11);
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||||
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@ -83,18 +83,24 @@ read_csr_as!(Mstatus, 0x300, __read_mstatus);
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set!(0x300, __set_mstatus);
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clear!(0x300, __clear_mstatus);
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/// User Interrupt Enable
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set_clear_csr!(set_uie, clear_uie, 1 << 0);
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||||
/// Supervisor Interrupt Enable
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set_clear_csr!(set_sie, clear_sie, 1 << 1);
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||||
/// Machine Interrupt Enable
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set_clear_csr!(set_mie, clear_mie, 1 << 3);
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||||
/// User Previous Interrupt Enable
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set_csr!(set_upie, 1 << 4);
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||||
/// Supervisor Previous Interrupt Enable
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||||
set_csr!(set_spie, 1 << 5);
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||||
/// Machine Previous Interrupt Enable
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set_csr!(set_mpie, 1 << 7);
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set_clear_csr!(
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||||
/// User Interrupt Enable
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, set_uie, clear_uie, 1 << 0);
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set_clear_csr!(
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||||
/// Supervisor Interrupt Enable
|
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, set_sie, clear_sie, 1 << 1);
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||||
set_clear_csr!(
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||||
/// Machine Interrupt Enable
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||||
, set_mie, clear_mie, 1 << 3);
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||||
set_csr!(
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||||
/// User Previous Interrupt Enable
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||||
, set_upie, 1 << 4);
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||||
set_csr!(
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||||
/// Supervisor Previous Interrupt Enable
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||||
, set_spie, 1 << 5);
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||||
set_csr!(
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||||
/// Machine Previous Interrupt Enable
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, set_mpie, 1 << 7);
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||||
/// Supervisor Previous Privilege Mode
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#[inline]
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pub unsafe fn set_spp(spp: SPP) {
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@ -56,15 +56,21 @@ read_csr_as!(Sie, 0x104, __read_sie);
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set!(0x104, __set_sie);
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clear!(0x104, __clear_sie);
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||||
/// User Software Interrupt Enable
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||||
set_clear_csr!(set_usoft, clear_usoft, 1 << 0);
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||||
/// Supervisor Software Interrupt Enable
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||||
set_clear_csr!(set_ssoft, clear_ssoft, 1 << 1);
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||||
/// User Timer Interrupt Enable
|
||||
set_clear_csr!(set_utimer, clear_utimer, 1 << 4);
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||||
/// Supervisor Timer Interrupt Enable
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||||
set_clear_csr!(set_stimer, clear_stimer, 1 << 5);
|
||||
/// User External Interrupt Enable
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||||
set_clear_csr!(set_uext, clear_uext, 1 << 8);
|
||||
/// Supervisor External Interrupt Enable
|
||||
set_clear_csr!(set_sext, clear_sext, 1 << 9);
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||||
set_clear_csr!(
|
||||
/// User Software Interrupt Enable
|
||||
, set_usoft, clear_usoft, 1 << 0);
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||||
set_clear_csr!(
|
||||
/// Supervisor Software Interrupt Enable
|
||||
, set_ssoft, clear_ssoft, 1 << 1);
|
||||
set_clear_csr!(
|
||||
/// User Timer Interrupt Enable
|
||||
, set_utimer, clear_utimer, 1 << 4);
|
||||
set_clear_csr!(
|
||||
/// Supervisor Timer Interrupt Enable
|
||||
, set_stimer, clear_stimer, 1 << 5);
|
||||
set_clear_csr!(
|
||||
/// User External Interrupt Enable
|
||||
, set_uext, clear_uext, 1 << 8);
|
||||
set_clear_csr!(
|
||||
/// Supervisor External Interrupt Enable
|
||||
, set_sext, clear_sext, 1 << 9);
|
||||
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@ -108,18 +108,24 @@ read_csr_as!(Sstatus, 0x100, __read_sstatus);
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set!(0x100, __set_sstatus);
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||||
clear!(0x100, __clear_sstatus);
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||||
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||||
/// User Interrupt Enable
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||||
set_clear_csr!(set_uie, clear_uie, 1 << 0);
|
||||
/// Supervisor Interrupt Enable
|
||||
set_clear_csr!(set_sie, clear_sie, 1 << 1);
|
||||
/// User Previous Interrupt Enable
|
||||
set_csr!(set_upie, 1 << 4);
|
||||
/// Supervisor Previous Interrupt Enable
|
||||
set_csr!(set_spie, 1 << 5);
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||||
/// Make eXecutable Readable
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set_clear_csr!(set_mxr, clear_mxr, 1 << 19);
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||||
/// Permit Supervisor User Memory access
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set_clear_csr!(set_sum, clear_sum, 1 << 18);
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||||
set_clear_csr!(
|
||||
/// User Interrupt Enable
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||||
, set_uie, clear_uie, 1 << 0);
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||||
set_clear_csr!(
|
||||
/// Supervisor Interrupt Enable
|
||||
, set_sie, clear_sie, 1 << 1);
|
||||
set_csr!(
|
||||
/// User Previous Interrupt Enable
|
||||
, set_upie, 1 << 4);
|
||||
set_csr!(
|
||||
/// Supervisor Previous Interrupt Enable
|
||||
, set_spie, 1 << 5);
|
||||
set_clear_csr!(
|
||||
/// Make eXecutable Readable
|
||||
, set_mxr, clear_mxr, 1 << 19);
|
||||
set_clear_csr!(
|
||||
/// Permit Supervisor User Memory access
|
||||
, set_sum, clear_sum, 1 << 18);
|
||||
|
||||
/// Supervisor Previous Privilege Mode
|
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#[inline]
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